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參數(shù)資料
| 型號(hào)： | Z80B-CTC |
| 英文描述： | Z8 Microcontrollers |
| 中文描述： | Z8微控制器 |
| 文件頁(yè)數(shù)： | 98/222頁(yè) |
| 文件大?。?/td> | 1595K |
| 代理商： | Z80B-CTC |
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Z8 Microcontrollers
Interrupts
ZiLOG
7-8
UM001600-Z8X0599
7.4 INTERRUPT INITIALIZATION
(Continued)
IMR is cleared before the IRQ enabling sequence to insure
no unexpected interrupts occur when EI is executed. This
code sequence should be executed prior to programming
the application required values for IPR and IMR.
Note:
IRQ bits 6 and 7 are device dependent. When
reserved, the bits are not used and will return a 0 when
read. When used as the Interrupt Edge select bits, the
configuration options are as show in Table 7-4.
The proper sequence for programming the interrupt edge
initialized):
Table 7-4. IRQ Register Configuration
IRQ
Interrupt Edge
P31
F
F
R
R/F
D7
0
0
1
1
D6
0
1
0
1
P32
F
R
F
R/F
Notes:
F = Falling Edge
R = Rising Edge
DI
;Inhibit all interrupts
until input edges are
configured
;Configure interrupt
do not disturb
edges as needed -
IRQ 0-5.
;Re-enable interrupts.
OR
IRQ,#XX 000000B
EI
Figure 7-10. IRQ Reset Functional Logic Diagram
S
Interrupt Request Register
(IRQ, FAH)
RESET
El Instruction
POR
R
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