參數(shù)資料
型號： XRT94L33IB-L
廠商： Exar Corporation
文件頁數(shù)： 349/465頁
文件大?。?/td> 0K
描述： IC MAPPER DS3/E3/STS-1 504TBGA
標(biāo)準(zhǔn)包裝： 24
應(yīng)用： 網(wǎng)絡(luò)切換
接口： 總線
電源電壓： 3.14 V ~ 3.47 V
封裝/外殼： 504-LBGA
供應(yīng)商設(shè)備封裝： 504-TBGA（35x35）
包裝： 托盤
安裝類型： 表面貼裝
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
412
Receive ATM Cell Processor Block – Receive ATM Control Register – Byte 1 (Address = 0xN702)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
GFC
Extraction
Enable
HEC Byte
Correction
Enable
Uncorrectable
HEC Byte
Error Discard
COSET
Polynomial
Addition
Regenerate
HEC Byte
Enable
R/O
R/W
0
X
0
1
0
Setting this bit-field to “0” disables “Correction Mode” operation within the HEC Byte Verification Block.
Conversely, setting this bit-field to “1” enables “Correction Mode” operation within the HEC Byte Verification
Block.
The “Detection” State
Unless “Correction Mode” operation is disabled (per the procedure described above), the HEC Byte
Verification Block will transition into the “Detection” State (within the “HEC Byte Error Detection/Correction”
algorithm.
Whenever the “HEC Byte Verification” block is operating in the “Detection” State, then ALL errored cells (e.g.,
those incoming cells that contain single-bit errors and multi-bit errors) will be discarded, unless configured
otherwise by the user.
More specifically, whenever the HEC Byte Verification block detects ANY cells with header byte errors, then it
will do all of the following.
1.
It will generate the “Detection of Uncorrectable HEC Byte Error” Interrupt.
The Receive ATM Cell
Processor block will indicate that it is declaring the “Detection of Uncorrectable HEC Byte Error” Interrupt, by
doing the following.
a.
Toggling the “INT*” output pin “l(fā)ow”.
b.
Setting Bit 2 (Detection of Uncorrectable HEC Byte Error Interrupt Status), within the “Receive ATM
Cell Processor Block – Receive ATM Interrupt Status Register – Byte 0” to “1” as depicted below.
2. It will increment the “Receive ATM Cell Processor Block – Receive ATM Cell with Uncorrectable HEC Byte
Error Count” Registers.
This is a 32-bit RESET-upon-READ register that resides at Address Locations
0xN734 through 0xN737. The bit format of these registers is presented below.
Receive ATM Cell Processor Block – Receive ATM Cells with Uncorrectable HEC Byte Error Count
Register – Byte 3 (Address = 0xN734)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Received Cells with Uncorrectable HEC Byte Error Count[31:24]
RUR
0
Receive ATM Cell Processor Block – Receive ATM Cells with Uncorrectable HEC Byte Error Count
Register – Byte 2 (Address = 0xN735)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Received Cells with Uncorrectable HEC Byte Error Count[23:16]
RUR
0
相關(guān)PDF資料
PDF描述
XRT94L43IB-F IC MAPPER SONET/SDH OC12 516BGA
XS1-G02B-FB144-I4 IC MCU 32BIT 16KB OTP 144FBGA
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3341-56 IC PLL INTEGER-N 3GHZ 20QFN
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參數(shù)描述
XRT94L43 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH STS-12/STM-4 TO E3/DS3/STS-1 MAPPER/DEMAPPER
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XRT94L43A 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
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XRT94L43ES-LC03 功能描述:時鐘合成器/抖動清除器 OC12-12XDS3MAPPER SCORPION 4x T73LC03A RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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