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參數(shù)資料
| 型號(hào)： | UPD703215 |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁(yè)數(shù)： | 198/861頁(yè) |
| 文件大?。?/td> | 4428K |
| 代理商： | UPD703215 |
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CHAPTER 6 CLOCK GENERATION FUNCTION
User’s Manual U16890EJ1V0UD
198
(1) Main clock oscillator
The main clock oscillator oscillates the following frequencies (f
X
):
f
X
= 2 to 2.5 MHz (REGC = V
DD
= 2.7 to 5.5 V, in PLL mode)
f
X
= 2 to 5 MHz (REGC = V
DD
= 4.5 to 5.5 V, in PLL mode)
f
X
= 2 to 4 MHz (REGC = capacitor, V
DD
= 4.0 to 5.5 V, in PLL mode)
f
X
= 2 to 10 MHz (REGC = V
DD
= 2.7 to 5.5 V, in clock-through mode)
Caution In the
μ
PD703215, 703215Y, 70F3214H, 70F3214HY, 70F3215H, and 70F3215HY, the main
clock oscillator oscillates the following frequencies (these values may change after
evaluation).
f
X
= 2 MHz (REGC = V
DD
= 2.7 to 5.5 V, in PLL mode)
f
X
= 2 to 5 MHz (REGC = V
DD
= 4.5 to 5.5 V, in PLL mode)
f
X
= 2 MHz (REGC = capacitor, V
DD
= 4.0 to 5.5 V, in PLL mode)
f
X
= 2 to 8 MHz (REGC = V
DD
= 2.7 to 5.5 V, in clock-through mode)
(2) Subclock oscillator
The subclock oscillator oscillates a frequency of 32.768 kHz (f
XT
).
(3) Main clock oscillator stop control
This circuit generates a control signal that stops oscillation of the main clock oscillator.
Oscillation of the main clock oscillator is stopped in the STOP mode or when the PCC.MCK bit = 1 (valid only
when the PCC.CLS bit = 1).
(4) Prescaler 1
This prescaler generates the clock (f
XX
to f
XX
/1024) to be supplied to the following on-chip peripheral functions:
TMP0
ADC, DAC, and WDT2
Note
, TM00 to TM03, TM50, TM51, TMH0, TMH1, CSI00, CSI01, CSIA0, CSIA1, UART0, UART1, I
2
C0,
Note
Only in the
μ
PD703215, 703215Y, 70F3215H, 70F3215HY
(5) Prescaler 2
This circuit divides the main clock (f
XX
).
The clock generated by prescaler 2 (f
XX
to f
XX
/32) is supplied to the selector that generates the CPU clock
(f
CPU
) and internal system clock (f
CLK
).
f
CLK
is the clock supplied to the INTC, ROM correction, ROM, and RAM blocks, and can be output from the
CLKOUT pin.
(6) Interval timer BRG
This circuit divides the clock (f
X
) generated by the main clock oscillator to a specific frequency (32.768 kHz)
and supplies that clock to the watch timer block.
For details, refer to
CHAPTER 11 INTERVAL TIMER, WATCH TIMER
.
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