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參數(shù)資料
| 型號： | UPD703130 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 58/72頁 |
| 文件大?。?/td> | 601K |
| 代理商： | UPD703130 |
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Preliminary Data Sheet U15390EJ1V0DS
58
μ
PD703130
(i) CBR refresh timing
Parameter
Symbol
Condition
MIN.
MAX.
Unit
RAS precharge time
<61>
t
RP
(1.5 + w
RRW
)T – 10
ns
RAS pulse width
<62>
t
RAS
(1.5 + w
RCW
Note
)T – 10
ns
CAS hold time
<108>
t
CHR
(1.5 + w
RCW
Note
)T – 10
ns
RAS precharge CAS hold time
<110>
t
RPC
(0.5 + w
RRW
)T – 10
ns
CAS setup time
<113>
t
CSR
T – 10
ns
Note
At least one clock cycle is inserted by default for w
RCW
regardless of the settings of the RCW0 to RCW2
bits of the RWC register.
Remarks 1.
T = t
CYK
2.
w
RRW
: The number of waits due to the RRW0 and RRW1 bits of the RWC register.
3.
w
RCW
: The number of waits due to the RCW0 to RCW2 bits of the RWC register.
Note
This TRCW is always inserted regardless of the settings of the RCW0 to RCW2 bits of the RWC register.
Remarks 1.
This is the timing for the following case.
Number of waits due to the RRW0 and RRW1 bits of the RWC register (TRRW): 1
Number of waits due to the RCW0 to RCW2 bits of the RWC register (TRCW): 2
2.
n = 3 to 5
TI
T3
TRCW
TRCW
Note
T2
T1
TRRW
RASn (Output)
<62>
UCAS (Output)
<108>
<110>
<61>
<113>
<110>
LCAS (Output)
CLKOUT (Output)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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