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參數(shù)資料
| 型號： | UPD703130 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 31/72頁 |
| 文件大?。?/td> | 601K |
| 代理商： | UPD703130 |
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Preliminary Data Sheet U15390EJ1V0DS
31
μ
PD703130
(d) DMA flyby transfer timing (SRAM
→
external I/O transfer) (2/2)
Remarks 1.
This is the timing when the number of waits due to the DWC1 and DWC2 registers is zero and w
F
= 0.
2.
The broken lines indicate high impedance.
3.
n = 0, 3 to 5, m = 0 to 3
CLKOUT (Output)
T1
TW
T2
<33>
<32>
<35>
<34>
<48>
<50>
<49>
<43>
<42>
<41>
<44>
<45>
<37>
<38>
<24>
<24>
<25>
<25>
<40>
<39>
A0 to A23 (Output)
CSn (Output)
RD (Output)
DMAAKm (Output)
IORD (Output)
IOWR (Output)
UWR, LWR (Output)
D0 to D15 (I/O)
WAIT (Input)
BCYST (Output)
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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