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參數(shù)資料
| 型號(hào)： | TMP86FH09NG |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PDIP32 |
| 封裝： | 0.400 INCH, 1.78 MM PITCH, LEAD FREE, PLASTIC, SDIP-32 |
| 文件頁(yè)數(shù)： | 112/154頁(yè) |
| 文件大?。?/td> | 1433K |
| 代理商： | TMP86FH09NG |
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5. I/O Ports
5.3 P2 (P22 to P20) Port
TMP86CH09NG
5.3 P2 (P22 to P20) Port
The P2 port is a 3-bit input/output port shared with external interrupt input, STOP canceling signal input, and low-
frequency resonator connecting pin. When using this port as an input port or function pin, set the output latch to 1.
The output latch is initialized to 1 when reset. When operating in dual-clock mode, connect a low-frequency resona-
tor (32.768 kHz) to the P21 (XTIN) and P22 (XTOUT) pins. When operating in single-clock mode, the P21 and P22
pins can be used as ordinary input/output ports. We recommend using the P20 pin for external interrupt input or
STOP canceling signal input or as an input port. (When used as an output port, the interrupt latch is set by a falling
edge.)
The P2 port has independent data input registers. To inspect the output latch status, read the P2DR register. To
inspect the pin status, read the P2PRD register. When the P2DR or P2PRD read instruction is executed for the P2
port, the values read from bits 7 to 3 are indeterminate.
Figure 5-4 P2 Port
Note: The P20 pin is shared with the STOP pin, so that when in STOP mode, its output goes to a High-Z state regardless of the
OUTEN status.
P2DR
(0002H)
R/W
76
543
21
0
P22
XTOUT
P21
XTIN
P20
INT5
STOP
(Initial value: **** *111)
P2PRD
(000DH)
Read only
76
543
21
0
P22
P21
P20
Output latch
Data input (P20PRD)
Data input (P21)
Data output
Data input (P20)
Control input
Data input (P21PRD)
Data input (P22)
Data input (P22PRD)
Data output
STOP
OUTEN
XTEN
fs
P22 (XTOUT)
P21 (XTIN)
P20 (INT5,STOP)
Osc. enable
D
Q
D
Q
D
Q
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