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參數(shù)資料
| 型號(hào)： | SYM53C825A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個(gè)PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 89/225頁 |
| 文件大?。?/td> | 1237K |
| 代理商： | SYM53C825A |
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SCSI Operating Registers
SYM53C825A/825AE Data Manual
5-15
SDMS uses the GPIO1-0 pins to support
serial EEPROM access. When serial EEPROM
access is enabled, GPIO1 is used as a clock and
GPIO0 is used as data. T he pins are controlled
from PCI configuration register 35h. T hey may
be read, but not controlled, from this register.
Register 08 (88)
SCSI First Byte Received (SFBR)
Read/Write
T his register contains the first byte received in any
asynchronous information transfer phase. For ex-
ample, when the SYM53C825A is operating in ini-
tiator mode, this register contains the first byte
received in the Message In, Status, and Data In
phases.
When a Block Move instruction is executed for a
particular phase, the first byte received is stored in
this register— even if the present phase is the same
as the last phase. T he first byte received value for a
particular input phase is not valid until after a
MOVE instruction is executed.
T his register is also the accumulator for register
read-modify-writes with the SFBR as the destina-
tion. T his allows bit testing after an operation.
T he SFBR is not writable via the CPU, and there-
fore not by a Memory Move. T he Load instruction
may not be used to write to this register. However,
it can be loaded via SCRIPT S Read/Write opera-
tions. T o load the SFBR with a byte stored in sys-
tem memory, the byte must first be moved to an
intermediate SYM53C825A register (such as the
SCRAT CH register), and then to the SFBR.
T his register will also contain the state of the lower
eight bits of the SCSI data bus during the selection
phase if the COM bit in the DCNT L register is
clear.
1B7
7
1B6
6
1B5
5
1B4
4
1B3
3
1B2
2
1B1
1
1B0
0
Default>>>
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0
0
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0
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PDF描述 |
|---|---|
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參數(shù)描述 |
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