參數(shù)資料
型號： ST92R195C
英文描述： ROMLESS HCMOS MCU WITH ON-SCREEN-DISPLAY AND TELETEXT DATA SLICER
中文描述： 無ROM HCMOS微控制器屏幕顯示和圖文電視數(shù)據(jù)限幅器
文件頁數(shù)： 58/208頁
文件大?。?/td> 2312K
代理商： ST92R195C
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ST92R195C - EXTERNAL MEMORY INTERFACE (EXTMI)
REGISTER DESCRIPTION
(Cont’d)
EXTERNAL MEMORY REGISTER 2 (EMR2)
R246
-
Read/Write
Register Page: 33
Reset value: 0000 1111 (0Fh)
Bit 7 = Reserved. Forced to 0 by hardware.
Bit 6 =
ENCSR
:
Enable code segment register.
This bit affects the ST9 CPU behaviour whenever
an interrupt request is issued. Refer to the descrip-
tion in the MMU chapter.
The bit is cleared on reset.
Bit 5 =
DPRREM
:
Data page registers remapping.
If DPRREM is set, the locations of the four MMU
(Memory Management Unit) Data Page Registers
(DPR0, DPR1, DPR2 and DPR3) are swapped
with that of the Data Registers of ports 0-3. The bit
is cleared at reset.
Bit 4 =
MEMSEL
:
Memory select.
0: No wait cycles added
1: Wait cycles added (number of cycles defined by
WPM[2:0] bits in the WCR if MMU5 = 0 or by
WDM[2:0] bits if MMU5 = 1.
.
Bit 3:2 =
PAS[1:0]
:
Program memory Address
strobe stretch
.
These two bits contain the number of wait cycles
(from 0 to 3) to add to the System Clock to stretch
ASN during external accesses to segments 0 to
1Fh (when MMU5=0). The reset value is 3.
Bit 1:0 =
DAS[1:0]
:
Data memory Address strobe
stretch
.
These two bits contain the number of wait cycles
(from 0 to 3) to add to the System Clock to stretch
ASN during external accesses to segments 20h to
3Fh (MMU5=1). The reset value is 3.
Note:
Calculation of PAS[1:0] & DAS[1:0] Values:
To calculate the number of wait cycles all the fol-
lowing formulas must be true:
For Write mode:
TAVWHmin < (WDM2-0 + 1) T
TAVWLmin < (PAS1-0 + 1/2) T
For Read mode:
TAVQVmax < (WPM2-0 +1) T
TAVQVmax < (WDM2-0 +1) T
Where:
T=
Clock period (40 ns at 25 MHz)
TAVWH= Address Valid to Write Low time
TAVWL= Address Valid to Write High time
TAVQV= Address Valid to Data Valid time
7
0
-
ENCSR DPRREM MEMSEL PAS1 PAS0 DAS1 DAS0
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PDF描述
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