參數(shù)資料
型號： ST92R195C
英文描述： ROMLESS HCMOS MCU WITH ON-SCREEN-DISPLAY AND TELETEXT DATA SLICER
中文描述： 無ROM HCMOS微控制器屏幕顯示和圖文電視數(shù)據(jù)限幅器
文件頁數(shù)： 125/208頁
文件大?。?/td> 2312K
代理商： ST92R195C
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125/208
ST92R195C - ON SCREEN DISPLAY (OSD)
ON SCREEN DISPLAY
(Cont’d)
8.4.10 Register Description
HORIZONTAL BLANK REGISTER (HBLANKR)
R240 - Read/Write
Register Page: 32
Reset Value: 0000 0011 (03h)
It controls the length of the Horizontal Blank which
follows the horizontal sync pulse.
Bits 7:0 =
HB[7:0]
: The horizontal blank period is
calculated with a pixel down counter loaded on
each Hsync by HB[7:0]. During this period, FB = 0
and (R, G, B) = black.
Thblank = [(HB7*128 + HB6*64 + HB5*32 +
HB4*16 + HB3*8 + HB2*4 + HB1*2 + HB0) * Tpix]
HORIZONTAL POSITION REGISTER (HPOSR)
R241 - Read/Write
Register Page: 32
Reset Value: 0000 0011 (03h)
Bits 7:0 =
HP[7:0]
: The horizontal start position is
calculated with a pixel down-counter loaded on
each Hsync by HP[7:0]. The first character display
starts when the counter turns to zero.
Hori delay= [(HP7*128 + HP6*64 + HP5*32 +
HP4*16 + HP3*8 + HP2*4 + HP1*2 + HP0) * Tpix]
+ Thblank
VERTICAL POSITION REGISTER (VPOSR)
R242 - Read/Write
Register Page: 32
Reset Value: 0000 0000(00h)
Bits 7:6 = Reserved, keep in reset state.
Bits 5:0 =
VP[5:0]:
The
vertical start position is cal-
culated with a line downcounter decremented on
each Hsync by VP[5:0]. The Display of the first row
begins when the counter turns to zero.
Vert delay = (VP5*32 + VP4*16 + VP3*8 + VP2*4
+ VP1*2 + VP0) * Tline (Tline= 64 μs)
7
0
HB7
HB6
HB5
HB4
HB3
HB2
HB1
HB0
7
0
HP7
HP6
HP5
HP4
HP3
HP2
HP1
HP0
7
0
0
0
VP5
VP4
VP3
VP2
VP1
VP0
相關PDF資料
PDF描述
STA003 MPEG 2.5 LAYER III AUDIO DECODER
STA10 ASIC
STA351A General Purpose Sink Driver Array
STA352A General Purpose Source Driver Array
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