參數(shù)資料
型號: S1C38000B0A0100
元件分類: 微控制器/微處理器
英文描述: 32-BIT, RISC MICROCONTROLLER, BGA239
封裝: CFLGA-239
文件頁數(shù): 92/281頁
文件大?。?/td> 1309K
代理商: S1C38000B0A0100
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17 DMA CONTROLLER
S1C38000 TECHNICAL MANUAL
EPSON
167
bits 17–16 reserved
These bits are reserved and must be written 0.
bits 15–14 Destination Address Mode Select Bits [1:0]
00
Destination address is always fixed
01
Destination address increments according to data transfer size (+1, +2, or +4 for
8-bit, 16-bit, or 32-bit, respectively)
10
Destination address decrements according to data transfer size (-1, -2, or -4 for 8-
bit, 16-bit, or 32-bit, respectively)
11
Reserved
bits 13–12 Source Address Mode Select Bits [1:0]
00
Source address is always fixed
01
Source address increments according to data transfer size (+1, +2, or +4 for 8-bit,
16-bit, or 32-bit, respectively)
10
Source address decrements according to data transfer size (-1, -2, or -4 for 8-bit,
16-bit, or 32-bit, respectively)
11
Reserved
bits 11–8
Resource Select Bits [3:0]
These bits specify the source of the DMA Device 2 trigger.
0000 Reserved
0001 Reserved
0010 Reserved
0011 Reserved
0100 Auto request (software trigger mode)
0101 Reserved
0110 Reserved
0111
Reserved
1000 Reserved
1001 Reserved
1010 IrDA FIR transmit or receive
1011 Reserved
1100 Reserved
1101 Reserved
1110
USB
1111
Reserved
bit 7
Reserved - must be programmed with 0; default is unknown.
bit 6
Reserved - must be programmed with 0.
bit 5
Transfer Mode
0
Cycle stealing mode (single transfer) - only one data transfer is performed per
DMA cycle, until the entire transfer count is completed.
1
Continuous mode (burst transfer) - transfers all data during one DMA cycle.
Channel 2 Control Register
DMA[2Ch]
Default = 0000 0000h
Read/Write
n/a
reserved reserved
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
Destination Address
Mode
Source Address
Mode
Resource Select
reserved reserved
Transmit
Mode
Transfer Size
Interrupt
Enable
Transfer
End
DMA
Enable
15
14
13
12
11
10
9876543210
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PDF描述
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