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參數(shù)資料
| 型號： | S1C38000B0A0100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, RISC MICROCONTROLLER, BGA239 |
| 封裝： | CFLGA-239 |
| 文件頁數(shù)： | 18/281頁 |
| 文件大?。?/td> | 1309K |
| 代理商： | S1C38000B0A0100 |
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11 POWER MANAGER
100
EPSON
S1C38000 TECHNICAL MANUAL
The following tables show the possible clock sources and frequencies for the six internal clocks
under normal operation. The selection is dependent on the System Configuration pins, MD[4:1], at
reset.
Note: LCDCLK frequency can be either LCDCLK source frequency or a divided-by-2 version of it (selected
via the LCDCLK Divide Select bit, CLK[04h] bit 31).
Table 11-2 BUSCLK Source and Frequency Options
MD2
Reset Configuration
MD[4:3]
Reset Configuration
BUSCLK
Source
BUSCLK Source
Default Frequency
BUSCLK
Frequency
0
(FCLK base freq. = 48 MHz)
00/01
PLLA
48 MHz
Others
–
1
(FCLK base freq. = 72 MHz)
00/01
PLLA
144 MHz
48 MHz
Others
–
Table 11-3 RTCLK Source and Frequency Options
RTCLK Source
RTCLK Source Default
Frequency
RTCLK Frequency
PLLA crystal input pins
32.768 kHz
Table 11-4 USBCLK Source and Frequency Options
MD[4:3]
Reset Configuration
USBCLK Source
MD1
Reset Configuration
USB/FIR clock
Frequency
00
PLLA
–
48.00512 MHz
01
PLLB
–
48.0000 MHz
Others
–
Table 11-5 LCDCLK Source and Frequency Options
MD[4:3] Reset
Configuration
LCDCLK Select
Bits [1:0]
LCDCLK Source
Default
Frequency
LCDCLK
Frequency
00, 01, 10
00/11: disabled
disabled
11
01: direct clock input
XB1
XB1 frequency
XB1 frequency or
1/2 (XB1 frequency)
00, 01, 10
10: 48 MHz
–
48 MHz
24 MHz or 48 MHz
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