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參數(shù)資料
| 型號(hào)： | PPC440GRX-STA400TZ |
| 廠(chǎng)商： | APPLIEDMICRO INC |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 400 MHz, RISC PROCESSOR, PBGA680 |
| 封裝： | 35 MM, THERMALLY ENHANCED, PLASTIC, BGA-680 |
| 文件頁(yè)數(shù)： | 77/88頁(yè) |
| 文件大?。?/td> | 1367K |
| 代理商： | PPC440GRX-STA400TZ |
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440GRx – PPC440GRx Embedded Processor
Revision 1.08 – October 15, 2007
AMCC Proprietary
79
Preliminary Data Sheet
Table 22. I/O Specifications—400MHz to 667MHz
Notes:
1. PerClk rising edge at package pin with a 10pF load trails the internal PLB clock by approximately 1.3ns.
Signal
Input (ns)
Output (ns)
Output Current (mA)
Clock
Notes
Setup Time
(TIS min)
Hold Time
(TIH min)
Valid Delay
(TOV max)
Hold Time
(TOH min)
I/O H
(minimum)
I/O L
(minimum)
External Slave Peripheral Interface
DMAAck0:3
n/a
6
1
19.1
8.7
PerClk
DMAReq0:3
4
1
n/a
PerClk
EOT0:3/TC0:3
4
1
6
1
19.1
8.7
PerClk
PerAddr02:31
4
1
6
1
19.1
8.7
PerClk
PerBLast
4
1
6
1
19.1
8.7
PerClk
PerCS0:5
n/a
6
1
19.1
8.7
PerClk
PerData00:15
4
1
6
1
19.1
8.7
PerClk
PerData16:31
4
1
6
1
14.6
6.6
PerClk
PerOE
n/a
6
1
19.1
8.7
PerClk
PerReady
4
1
n/a
19.1
8.7
PerClk
PerR/W
4
1
6
1
19.1
8.7
PerClk
PerWBE0:1
4
1
6
1
19.1
8.7
PerClk
External Master Peripheral Interface
BusReq
n/a
6
1
19.1
8.7
PerClk
ExtAck
n/a
6
1
19.1
8.7
PerClk
ExtReq
4
1
n/a
19.1
8.7
PerClk
ExtReset
n/a
6
1
19.1
8.7
PerClk
HoldAck
n/a
6
1
19.1
8.7
PerClk
HoldReq
4
1
n/a
PerClk
HoldPri
4
1
n/a
PerClk
19.1
8.7
PLB Clk
1
PerErr
4
1
n/a
PerClk
NAND Flash Interface
NFALE
n/a
6
1
19.1
8.7
PerClk
NFCE0:3
n/a
6
1
19.1
8.7
PerClk
NFCLE
n/a
6
1
19.1
8.7
PerClk
NFRdyBusy
4
1
n/a
PerClk
NFREn
n/a
6
1
19.1
8.7
PerClk
NFWEn
n/a
6
1
19.1
8.7
PerClk
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