參數(shù)資料
型號： MCHC908RK2CSDR2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20
封裝： PLASTIC, SSOP-20
文件頁數(shù)： 64/181頁
文件大?。?/td> 2384K
代理商： MCHC908RK2CSDR2
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Development Support
Data Sheet
MC68HC908RK2 — Rev. 5.0
156
Development Support
MOTOROLA
Table 12-2 is a summary of the differences between user mode and monitor mode.
12.3.1.2 Data Format
Communication with the monitor ROM is in standard non-return-to-zero (NRZ)
mark/space data format. (See Figure 12-6 and Figure 12-7.)
The data transmit and receive rate is determined by the crystal. Transmit and
receive baud rates must be identical.
Figure 12-6. Monitor Data Format
Figure 12-7. Sample Monitor Waveforms
Table 12-2. Mode Differences
Modes
Functions
COP
Reset
Vector
High
Reset
Vector
Low
Break
Vector
High
Break
Vector
Low
SWI
Vector
High
SWI
Vector
Low
User
Enabled
$FFFE
$FFFF
$FFFC
$FFFD
$FFFC
$FFFD
Monitor
Disabled(1)
1. If the high voltage (VTST) is removed from the IRQ pin while in monitor mode, the SIM asserts
its COP enable output. The COP is a mask option enabled or disabled by the COPD bit in the
$FEFE
$FEFF
$FEFC
$FEFD
$FEFC
$FEFD
BIT 5
START
BIT
BIT 0
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
BIT 3
BIT 4
BIT 6
BIT 7
Notes: 1 = Echo delay (2 bit times)
2 = Data return delay (2 bit times)
3 = Wait 1 bit time before sending next byte.
1, 2, 3
BIT 5
START
BIT
BIT 0
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
BIT 3
BIT 4
BIT 6
BIT 7
START
BIT
BIT 0
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
$A5
BREAK
BIT 3
BIT 4
BIT 5
BIT 6
BIT 7
Notes: 1 = Echo delay (2 bit times)
2 = Data return delay (2 bit times)
3 = Wait 1 bit time before sending next byte.
1, 2, 3
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