參數(shù)資料
型號： MCHC908RK2CSDR2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20
封裝： PLASTIC, SSOP-20
文件頁數(shù)： 32/181頁
文件大小： 2384K
代理商： MCHC908RK2CSDR2
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System Integration Module (SIM)
Low-Power Modes
MC68HC908RK2 — Rev. 5.0
Data Sheet
MOTOROLA
System Integration Module (SIM)
127
Figure 10-14. Wait Recovery from Internal Reset
The SIM disables the clock generator module outputs (CGMOUT and CGMXCLK)
in stop mode, stopping the CPU and peripherals. Stop recovery time is selectable
using the SSREC bit in the CONFIG register. If SSREC is set, stop recovery is
reduced from the normal delay of 4096 CGMXCLK cycles down to 32. This is ideal
for applications using canned oscillators that do not require long startup times from
stop mode.
NOTE:
External crystal applications should use the full stop recovery time by clearing the
SSREC bit.
The SIM counter is held in reset from the execution of the STOP instruction until the
beginning of stop recovery. It is then used to time the recovery period. Figure
10-15 shows stop mode entry timing.
Figure 10-15. Stop Mode Entry Timing
IAB
IDB
RST
$A6
$6E0B
RSTVCTH
RSTVCTL
$A6
CGMXCLK
32
CYCLES
32
CYCLES
STOP ADDR + 1
SAME
IAB
IDB
PREVIOUS DATA
NEXT OPCODE
SAME
STOP ADDR
SAME
R/W
CPUSTOP
Note: Previous data can be operand data or the STOP opcode, depending on the last instruction.
相關PDF資料
PDF描述
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MCIMX31LCVMN4D 32-BIT, 400 MHz, MICROPROCESSOR, PBGA473
MCIMX31CVMN4D 32-BIT, 400 MHz, MICROPROCESSOR, PBGA473
MCIMX31LCJMN4D 32-BIT, 400 MHz, MICROPROCESSOR, PBGA473
MCIMX31LVKN5C 532 MHz, MICROPROCESSOR, PBGA457
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參數(shù)描述
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