參數(shù)資料
型號(hào)： MCHC908RK2CSDR2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20
封裝： PLASTIC, SSOP-20
文件頁數(shù)： 168/181頁
文件大?。?/td> 2384K
代理商： MCHC908RK2CSDR2
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Internal Clock Generator Module (ICG)
I/O Registers
MC68HC908RK2 — Rev. 5.0
Data Sheet
MOTOROLA
Internal Clock Generator Module (ICG)
87
6.7 I/O Registers
The ICG contains five registers, summarized in Figure 6-11. These registers are:
ICG control register, ICGCR
ICG multiplier register, ICGMR
ICG trim register, ICGTR
ICG DCO divider control register, ICGDVR
ICG DCO stage control register, ICGDSR
Several of the bits in these registers have interaction where the state of one bit may
force another bit to a particular state or prevent another bit from being set or
cleared. A summary of this interaction is shown in Table 6-5.
Addr.
Register Name
Bit 7
654321
Bit 0
$0036
Internal Clock Generator
Control Register (ICGCR)
Read:
CMIE
CMF
CMON
CS
ICGON
ICGS
ECGON
ECGS
Write:
Reset:
00001000
$0037
Internal Clock Generator
Multiplier Register (ICGMR)
Read:
R
N6N5
N4N3N2N1N0
Write:
Reset:
00010101
$0038
Internal Clock Generator
Trim Register (ICGTR)
Read:
TRIM7
TRIM6
TRIM5
TRIM4
TRIM3
TRIM2
TRIM1
TRIM0
Write:
Reset:
10000000
$0039
ICG DCO Divider Control
Register (ICGDVR)
Read:
RRRR
DDIV3
DDIV2
DDIV1
DDIV0
Write:
Reset:
0000
UUUU
$003A
ICG DCO Stage Register
(ICGDSR)
Read:
DSTG7
DSTG6
DSTG5
DSTG4
DSTG3
DSTG2
DSTG1
DSTG0
Write:
Reset:
Unaffected by reset
= Unimplemented
R
= Reserved
U = Unaffected
Figure 6-11. ICG I/O Register Summary
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PDF描述
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MCIMX31CVMN4D 32-BIT, 400 MHz, MICROPROCESSOR, PBGA473
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