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參數(shù)資料
| 型號： | MCHC908RK2CSDR2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20 |
| 封裝： | PLASTIC, SSOP-20 |
| 文件頁數(shù)： | 147/181頁 |
| 文件大?。?/td> | 2384K |
| 代理商： | MCHC908RK2CSDR2 |
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Internal Clock Generator Module (ICG)
Data Sheet
MC68HC908RK2 — Rev. 5.0
68
Internal Clock Generator Module (ICG)
MOTOROLA
6.3.1 Clock Enable Circuit
The clock enable circuit is used to enable the internal clock (ICLK) or external clock
(ECLK). The clock enable circuit generates an ICG stop (ICGSTOP) signal which
stops all clocks (ICLK, ECLK, and the low-frequency base clock, IBASE) low.
ICGSTOP is set and the ICG is disabled in stop mode.
The internal clock enable signal (ICGEN) turns on the internal clock generator
which generates ICLK. ICGEN is set (active) whenever the ICGON bit is set and
the ICGSTOP signal is clear. When ICGEN is clear, ICLK and IBASE are both low.
The external clock enable signal (ECGEN) turns on the external clock generator
which generates ECLK. ECGEN is set (active) whenever the ECGON bit is set and
the ICGSTOP signal is clear. When ECGEN is clear, ECLK is low.
6.3.2 Internal Clock Generator
The internal clock generator, shown in Figure 6-3, creates a low-frequency base
clock (IBASE), which operates at a nominal frequency (fNOM) of 307.2 kHz ±25%,
and an internal clock (ICLK) which is an integer multiple of IBASE. This multiple is
the ICG multiplier factor (N), which is programmed in the ICG multiplier register
(ICGMR). The internal clock generator is turned off and the output clocks (IBASE
and ICLK) are held low when the internal clock generator enable signal (ICGEN) is
clear.
Figure 6-3. Internal Clock Generator Block Diagram
DIGITALLY
CONTROLLED
OSCILLATOR
ICLK
MODULO
N
DIVIDER
FREQUENCY
COMPARATOR
CLOCK GENERATOR
TRIM[7:0]
VOLTAGE &
CURRENT
REFERENCES
DIGITAL
LOOP
FILTER
++
+
–
– –
N[6:0]
DSTG[7:0]
ICGEN
IBASE
DDIV[3:0]
NAME
REGISTER BIT
MODULE SIGNAL
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