參數(shù)資料
型號: MC68307PU16
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 16-BIT, 16.67 MHz, MICROCONTROLLER, PQFP100
封裝: TQFP-100
文件頁數(shù): 7/264頁
文件大?。?/td> 949K
代理商: MC68307PU16
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System Integration Module
MOTOROLA
MC68307 USER’S MANUAL
5-9
register locations ($0000F0–$0000FF), since no potential bus
contention can occur.
The chip select logic does not allow an address match during in-
terrupt acknowledge (function code 7) cycles.
The programming of the chip select module is discussed in the next chapter. For further
5.1.3 External Bus Interface Logic
This logic controls the interaction of the EC000 core processor, the on-chip M68000
peripheral bus, the external M68000 and 8051-compatible buses, in conjunction with the
programmable chip select logic and the various user settings in the system configuration
and protection logic. A block diagram of this logic is shown in Figure 5-3.
5.1.3.1 M68000 BUS INTERFACE. The M68000 bus interface adds bus-sizing functionality
(8-bit or 16-bit data bus) to the basic M68000 bus of the EC000 core processor. The external
bus interface logic links the data bus multiplexers with the programmable chip selects and
SCR bits, and co-ordinates an 8-bit or 16-bit bus transfer. The BUSWx bits in the SCR define
the current data-bus width (port size) for each of the four chip selects. On cold reset, the
Figure 5-3. External Bus Interface Logic
ALE
WR
RD
AD7–AD0
D15–D0
A23–A8
CS2/CS2A
CS2
PA0/CS2B
PA1/CS2C
PA2/CS2D
CS3
CS1
CS0
E8051
EPCS
PORT A DATA
PORT A DDR
PORT A CONTROL
PAX
EC000 CORE
D15–D0
CTRL
A23–A0
CHIP-SELECTS
CONTROL
SCR
EPCS
E8051
BUSWX
PORT A LOGIC
PADAT
PADDR
PACNT
PORT A
MUX
LOGIC
PERIPH
CHIP-SELECT
DECODE
8051-BUS
TIMING AND
MUX LOGIC
EXTERNAL
DATA BUS
SIZE
CONTROL
LOGIC
CS0
CS1
CS2
CS3
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PDF描述
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