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參數(shù)資料
| 型號： | DS31412N |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 47/89頁 |
| 文件大小： | 0K |
| 描述： | IC 12CH DS3/3 FRAMER 349-BGA |
| 標準包裝： | 1 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 電流 - 電源： | 960mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 349-BGA 裸露焊盤 |
| 供應商設(shè)備封裝： | 349-HCBGA（27x27） |
| 包裝： | 托盤 |
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DS3146/DS3146/DS31412 6-/8-/12-Channel DS3/E3 Framers
51 of 89
Register Name:
BSRIE
Register Description:
BERT Status Register Interrupt Enable
Register Address:
3Ah
Bit #
7
6
5
4
3
2
1
0
Name
N/A
BEDIE
BBCOIE
BECOIE
SYNCIE
Default
—
0
Bit 0: Synchronization Status Interrupt Enable (SYNCIE). This bit enables an interrupt if the SYNCL bit in the
BSRL register is set.
0 = interrupt disabled
1 = interrupt enabled
Bit 1: BERT Error-Counter Overflow Interrupt Enable (BECOIE). This bit enables an interrupt if the BECOL bit
in the BSRL register is set.
0 = interrupt disabled
1 = interrupt enabled
Bit 2: BERT Bit-Counter Overflow Interrupt Enable (BBCOIE). This bit enables an interrupt if the BBCOL bit in
the BSRL register is set.
0 = interrupt disabled
1 = interrupt enabled
Bit 3: Bit Error-Detected Interrupt Enable (BEDIE). This bit enables an interrupt if the BEDL bit in the BSRL
register is set.
0 = interrupt disabled
1 = interrupt enabled
Figure 7-6. BERT Status Bit Interrupt Signal Flow
BOTH EDGE
DETECT
LATCH
POS EDGE
DETECT
LATCH
POS EDGE
DETECT
LATCH
POS EDGE
DETECT
LATCH
BSRL.SYNCL
BSRIE.SYNCIE
BSRL.BECOL
BSRL.BBCOL
BSRL.BEDL
BSRIE.BECOIE
BSRIE.BBCOIE
BSRIE.BEDIE
BSR.SYNC
PATTERN
SYNC FROM
BERT
RECEIVER
OVERFLOW
FROM BERT
ERROR
COUNTER
OVERFLOW
FROM BERT
BIT COUNTER
INT PIN (ORed
WITH OTHER
SOURCES)
MSRIE.BERTIE
MSR.BERT
BSR.BECO
BSR.BBCO
OR
BIT ERROR
DETECT
FROM BERT
RECEIVER
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