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參數(shù)資料
| 型號： | AT89C51SND2C-7FTUL |
| 廠商： | Atmel |
| 文件頁數(shù)： | 20/160頁 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU FLASH 64K MP3 100BGA |
| 標(biāo)準(zhǔn)包裝： | 260 |
| 系列： | 89C |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | I²C，IDE/ATAPI，MMC，SPI，UART/USART，USB |
| 外圍設(shè)備： | 音頻，I²S，MP3，PCM，POR，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.3 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TFBGA |
| 包裝： | 托盤 |
| 其它名稱： | AT89C51SND2C7FTUL |
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4341H–MP3–10/07
AT8xC51SND2C/MP3B
Figure 5-4.
PLL Block Diagram and Symbol
Figure 5-5.
PLL Filter Connection
5.3.2
PLL Programming
The PLL is programmed using the flow shown in Figure 5-6. As soon as clock generation is
enabled, the user must wait until the lock indicator is set to ensure the clock output is stable. The
PLL clock frequency will depend on MP3 decoder clock and audio interface clock frequencies.
Figure 5-6.
PLL Programming Flow
PLLEN
PLLCON.1
N6:0
N divider
R divider
VCO
PLLclk
OSCclk
R
1
+
(
)
×
N
1
+
-----------------------------------------------
=
OSC
CLOCK
PFLD
PLOCK
PLLCON.0
PFILT
CHP
Vref
Up
Down
R9:0
PLL
CLOCK
PLL Clock Symbol
PLL
Clock
VSS
FILT
R
C1
C2
VSS
PLL
Programming
Configure Dividers
N6:0 = xxxxxxb
R9:0 = xxxxxxxxxxb
Enable PLL
PLLRES = 0
PLLEN = 1
PLL Locked?
PLOCK = 1?
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
| AT89C51-W | 功能描述:8位微控制器 -MCU Microcontroller RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| AT89C52 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:8-Bit Microcontroller with 8K Bytes Flash |
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