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參數(shù)資料
| 型號： | ADUC7034BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 72/136頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU FLASH 32K ANLG IO 48LFCSP |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設備： | POR，PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 9 |
| 程序存儲器容量： | 32KB（16K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 2x16b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 115°C |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 包裝： | 托盤 |
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ADuC7034
Rev. B | Page 40 of 136
16-BIT SIGMA-DELTA ANALOG-TO-DIGITAL CONVERTERS
The ADuC7034 incorporates two independent sigma-delta
(Σ-Δ) analog-to-digital converters (ADCs), namely, the current
channel ADC (I-ADC) and the voltage/temperature channel ADC
(V-/T-ADC). These precision measurement channels integrate
on-chip buffering, a programmable gain amplifier, 16-bit Σ-Δ
modulators, and digital filtering for precise measurement of
current, voltage, and temperature variables in 12 V automotive
battery systems.
CURRENT CHANNEL ADC (I-ADC)
The I-ADC converts battery current sensed through an external
100 μΩ shunt resistor. On-chip programmable gain means that
the I-ADC can be configured to accommodate battery current
levels from ±1 A to ±1500 A.
As shown in Figure 17, the I-ADC employs a Σ-Δ conversion
technique to attain 16 bits of no missing codes performance.
The Σ-Δ modulator converts the sampled input signal into a
digital pulse train whose duty cycle contains the digital infor-
mation. A modified sinc3 programmable low-pass filter is then
employed to decimate the modulator output data stream to
provide a valid 16-bit data conversion result at programmable
output rates from 4 Hz to 8 kHz in normal mode and from 1 Hz
to 2 kHz in low power mode.
The I-ADC also incorporates counter, comparator, and
accumulator logic. This allows the I-ADC result to generate an
interrupt after a predefined number of conversions has elapsed
or a programmable threshold value has been exceeded. A fast
ADC overrange feature is also supported. Once enabled, a 32-bit
accumulator automatically sums the 16-bit I-ADC results.
The time to a first valid (fully settled) result on the current channel
is three ADC conversion cycles with chop mode disabled and two
ADC conversion cycles with chop mode enabled.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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