參數(shù)資料
型號： ADUC7034BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 27/136頁
文件大?。?/td> 0K
描述： IC MCU FLASH 32K ANLG IO 48LFCSP
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲器容量： 32KB（16K x 16）
程序存儲器類型： 閃存
RAM 容量： 1K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
包裝： 托盤
ADuC7034
Rev. B | Page 122 of 136
LIN Frame Data Transmission and Reception
To manage data on the LIN bus requires use of the following
UART MMRs:
When the break symbol and synchronization byte have been
correctly received, data is transmitted and received via the
COMTX and COMRX MMRs after UART is configured to the
required baud rate. To configure UART for use with LIN requires
the use of the following UART MMRs:
COMTX: 8-bit transmit register.
COMRX: 8-bit receive register.
COMCON0: line control register.
COMSTA0: line status register.
COMDIV0: divisor latch (low byte).
In addition, transmitting data on the LIN bus requires that the
relevant data be placed into COMTX, and reading data received
on the LIN bus requires the monitoring of COMRX. To ensure
that data is received or transmitted correctly, COMSTA0 should
be monitored. For more information, refer to the UART Serial
COMDIV1: divisor latch (high byte).
COMDIV2: 16-bit fractional baud divider register. The
required values for COMDIV0, COMDIV1, and COMDIV2
are derived from the LHSVAL0 to generate the required
baud rate.
COMCON0: line control register. As soon as UART is
correctly configured, the LIN protocol for receiving and
transmitting data is identical to the UART specification.
Under software control, it is possible to multiplex the UART data
lines (TxD and RxD) to the external GPIO_7 and GPIO_8 pins.
For more information, refer to the GPIO Port1 Control Register
(GP1CON) section.
13
tBIT
2
tBIT
2
tBIT
2
tBIT
2
tBIT
>1
tBIT
> = 14
tBIT
8
tBIT
BREAK
SYNC
STA S0
S1
S2
S3
S4
S5
S6
S7 STO
PROTECTED ID
07
11
6-
0
42
Figure 46. LIN Interface Timing
tBREAK > 13tBIT
BREAK
DELIMIT
START
BIT
07
11
6-
0
43
Figure 47. LIN Break Field
tBIT
STOP
BIT
START
BIT
07
11
6-
04
4
Figure 48. LIN Sync Byte Field
ID1
ID0
START
BIT
STOP
BIT
tBIT
ID2
ID3
ID4
ID5
P0
P1
0
7
116
-045
Figure 49. LIN Identifier Byte Field
BIT1
BIT0
START
BIT
STOP
BIT
tBIT
BIT2
BIT3
BIT4
BIT5
BIT6
BIT7
07
11
6-
04
6
Figure 50. LIN Data Byte Field
相關(guān)PDF資料
PDF描述
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