參數(shù)資料
型號(hào)： ADUC7034BCPZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 7/136頁(yè)
文件大?。?/td> 0K
描述： IC MCU FLASH 32K ANLG IO 48LFCSP
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲(chǔ)器容量： 32KB（16K x 16）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 1K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤(pán)，CSP
包裝： 托盤(pán)
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ADuC7034
Rev. B | Page 104 of 136
UART SERIAL INTERFACE
The ADuC7034 features a 16,450-compatible UART. The UART
is a full-duplex, universal, asynchronous receiver/transmitter. A
UART performs serial-to-parallel conversion on data characters
received from a peripheral device and performs parallel-to-serial
conversion on data characters received from the ARM7TDMI.
The UART features a fractional divider that facilitates high
accuracy baud rate generation and a network addressable mode.
The UART functionality is available on the GPIO_5/RxD and
GPIO_6/TxD pins of the ADuC7034.
The serial communication adopts an asynchronous protocol that
supports various word lengths, stop bits, and parity generation
options selectable in the configuration register.
BAUD RATE GENERATION
The ADuC7034 features two methods of generating the UART
baud rate: normal 450 UART baud rate generation and ADuC7034
fractional divider baud rate generation.
Normal 450 UART Baud Rate Generation
The baud rate is a divided version of the core clock using the
values in the COMDIV0 and COMDIV1 MMRs (each is a 16-bit
value, DL). The standard baud rate generator formula is
DL
Rate
Baud
CD
×
=
2
16
2
MHz
48
.
20
(1)
Table 78 lists common baud rate values.
Table 78. Baud Rate Using the Standard Baud Rate Generator
Baud Rate (bps)
CD
DL
Actual Baud Rate
% Error
9600
0
0x43
9552
0.50%
19,200
0
0x21
19,394
1.01%
115,200
0
0x6
106,667
7.41%
9600
3
0x8
10,000
4.17%
19,200
3
0x4
20,000
4.17%
115,200
3
0x1
80,000
30.56%
ADuC7034 Fractional Divider Baud Rate Generation
The fractional divider combined with the normal baud rate gen-
erator allows the generation of accurate, high speed baud rates.
/2
/(M+N/2048)
/16DL
UART
CORE
CLOCK
FBEN
071
16
-03
8
Figure 42. Fractional Divider Baud Rate Generation
Calculation of the baud rate using a fractional divider is as follows:
)
2048
(
2
16
2
MHz
48
.
20
N
M
DL
Rate
Baud
CD
+
×
=
(2)
2
16
2
MHz
48
.
20
2048
×
=
+
DL
Rate
Baud
N
M
CD
where:
CD is the clock divider.
DL is the divisor latch.
M is the integer part of the divisor; a fractional divider divides
an input by a nonwhole number M.N.
N is the fractional part of the divisor; a fractional divider
divides an input by a nonwhole number M.N.
Table 79 lists common baud rate values.
Table 79. Baud Rate Using the Fractional Baud Rate Generator
Baud
Rate
(bps)
CD
DL
M
N
Actual
Baud Rate
% Error
9600
0
0x42
1
21
9598.55
0.015%
19,200
0
0x21
1
21
19,197.09
0.015%
115,200
0
0x5
1
228
115,177.51
0.0195%
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PDF描述
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