參數(shù)資料
型號： ADUC7034BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 21/136頁
文件大小： 0K
描述： IC MCU FLASH 32K ANLG IO 48LFCSP
標準包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲器容量： 32KB（16K x 16）
程序存儲器類型： 閃存
RAM 容量： 1K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
包裝： 托盤
ADuC7034
Rev. B | Page 117 of 136
LIN (LOCAL INTERCONNECT NETWORK) INTERFACE
The ADuC7034 features high voltage physical interfaces
between the ARM7 MCU core and an external LIN bus. The
LIN interface operates as a slave only interface, operating from
1 kBaud to 20 kBaud, and it is compatible with the LIN 2.0
standard. The pull-up resistor required for a slave node is on
chip, reducing the need for external circuitry. The LIN protocol
is emulated using the on-chip UART, an IRQ, a dedicated LIN
timer, and the high voltage transceiver (also incorporated on
chip) as shown in Figure 45. The LIN is clocked from the low
power oscillator for the break timer, and a 5 MHz output from
the PLL is used for the synchronous byte timing.
LIN MMR DESCRIPTION
The LIN hardware synchronization (LHS) functionality is con-
trolled through five MMRs. The function of each MMR is as
follows:
LHSSTA: LHS status register. This MMR contains information
flags that describe the current status on the interface.
LHSCON0: LHS Control Register 0. This MMR controls
the configuration of the LHS timer.
LHSCON1: LHS start and stop edge control register. This
MMR dictates on which edge of the LIN synchronization byte
the LHS starts/stops counting.
LHSVAL0: LHS synchronization 16-bit timer. This MMR is
controlled by LHSCON0.
LHSVAL1: LHS break timer register.
GPIO12
FUNCTION
SELECT
GP2CON[20]
GPIO12
GP2DAT[29]
AND
GPSDAT[21]
UART
LHS
HARDWARE
RxD
TxD
BPF
INTERNAL
SHORT-CIRCUIT
TRIP REFERENCE
INTERNAL
SHORT-CIRCUIT
SENSE
RESISTOR
SHORT-CIRCUIT
CONTROL
HVCFG1[2]
OUTPUT
DISABLE
LIN MODE
HVCFG0[1:0]
INPUT
VOLTAGE
THRESHOLD
REFERENCE
LIN ENABLE
(INTERNAL
PULL-UP)
HVCFG0[5]
FOUR LIN
INTERRUPT
SOURCES:
BREAK LHSSTA[0]
START LHSSTA[1]
STOP LHSSTA[2]
BREAK
ERROR LHSSTA[4]
VDD
RxD ENABLE
LHSCON0[8]
LHSVAL0
LHSVAL1
LHS INTERRUPT
IRQEN[7]
5MHz
131kHz
LHS
INTERRUPT
LOGIC
VDD
SCR
IO_VSS
OVERVOLTAGE
PROTECTION
EXTERNAL
LIN PIN
MASTER ECU
PROTECTION
DIODE
MASTER ECU
PULL-UP
CLOAD
0
71
16
-0
41
Figure 45. LIN I/O Block Diagram
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PDF描述
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