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參數資料
| 型號： | ADUC7034BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 32/136頁 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 32K ANLG IO 48LFCSP |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設備： | POR，PSM，溫度傳感器，WDT |
| 輸入/輸出數： | 9 |
| 程序存儲器容量： | 32KB（16K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 數據轉換器： | A/D 2x16b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 115°C |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 包裝： | 托盤 |
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ADuC7034
Rev. B | Page 127 of 136
BSD RELATED MMRS
The ADuC7034 emulates the BSD communication protocol
using a software (bit bang) interface with some hardware assis-
tance from the LIN hardware synchronization logic. In effect,
the ADuC7034 BSD interface uses the following protocols:
An internal GPIO signal (GPIO_12) that is routed to the
external LIN/BSD pin and is controlled directly by
software to generate 0s and 1s.
When reading bits, the LIN synchronization hardware uses
LHSVAL1 to count the width of the incoming pulses so
that user code can interpret the bits as sync, 0, or 1.
When writing bits, user code toggles a GPIO pin and uses
the LHSCAP and LHSCMP registers to time pulse widths
and generate an interrupt when the BSD output pulse
width has reached its required width.
The ADuC7034 MMRs required for BSD communication are as
follows:
LHSSTA: LIN hardware sync status register.
LHSCON0: LIN hardware sync control register.
LHSVAL0: LIN Hardware Sync Timer0 (16-bit timer).
LHSCON1: LIN hardware sync edge setup register.
LHSVAL1: LIN sync break timer.
LHSCAP: LIN sync capture register.
LHSCMP: LIN sync compare register.
IRQEN/CLR: Enable interrupt register.
FIQEN/CLR: Enable fast interrupt register.
GP2DAT: GPIO data register.
GP2SET: GPIO set register.
GP2CLR: GPIO clear register.
Detailed bit definitions for most of these MMRs have been
listed previously. In addition to the registers described in the
LIN MMR Description section, LHSCAP and LHSCMP are
new registers that are required for the operation of the BSD
interface. Details of these registers are included in the LIN
Synchronization Compare Register sections.
LIN Hardware Synchronization Capture Register
Name:
LHSCAP
Address:
0xFFFF0794
Default Value:
0x0000
Access:
Read only
Function:
This 16-bit, read only LHSCAP register holds
the last captured value of the internal LIN
synchronization timer (LHSVAL0). In BSD
mode, the LHSVAL0 is clocked directly from
an internal 5 MHz clock, and its value is
loaded into the capture register on every
falling edge of the BSD bus.
LIN Hardware Synchronization Compare Register
Name:
LHSCMP
Address:
0xFFFF0798
Default Value:
0x0000
Access:
Read/write
Function:
The LHSCMP register is used to time BSD
output pulse widths. When enabled through
LHSCON0[5], a LIN interrupt is generated
when the value in LHSCAP equals the value
written in LHSCMP. This functionality allows
user code to determine how long a BSD
transmission bit (sync, 0, or 1) should be
asserted on the bus.
相關PDF資料 |
PDF描述 |
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參數描述 |
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