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參數(shù)資料
| 型號(hào)： | ADUC7034BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 135/136頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU FLASH 32K ANLG IO 48LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設(shè)備： | POR，PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 9 |
| 程序存儲(chǔ)器容量： | 32KB（16K x 16） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 1K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 2x16b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 115°C |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 包裝： | 托盤 |
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ADuC7034
Rev. B | Page 98 of 136
High Voltage Configuration0 Register
Name:
HVCFG0
Address:
Indirectly addressed via the HVCON high voltage interface
Default Value:
0x00
Access:
Read/write
Function:
This 8-bit register controls the function of high voltage circuits on the ADuC7034. This register is not an MMR and does
not appear in the Complete MMR Listing section. It is accessed indirectly via the HVCON MMR, and data is indirectly
written to or read from this register via the HVDAT MMR.
Table 73. HVCFG0 Bit Designations
Bit
Description
7
Wake-up/STI thermal shutdown disable.
Set to 1 to disable the automatic shutdown of the wake/STI driver when a thermal event occurs.
Cleared to 0 to enable the automatic shutdown of the wake/STI driver when a thermal event occurs.
6
Precision oscillator enable bit.
Set to 1 to enable the precision 131 kHz oscillator. The oscillator start-up time is typically 70 μs (including a high
voltage interface latency of 10 μs).
Cleared to 0 to power down the precision 131 kHz oscillator.
5
Bit serial device (BSD) mode enable bit.
Set to 1 to disable the internal (LIN) pull-up and to configure the LIN/BSD pin for BSD operation.
Cleared to 0 to enable an internal (LIN) pull-up resistor on the LIN/BSD pin.
4
Wake-up (WU) assert bit.
Set to 1 to assert the external WU pin high.
Cleared to 0 to pull the external WU pin low via an internal 10 kΩ pull-down resistor.
3
Power supply monitor (PSM) enable bit.
Set to 1 to enable the power supply (voltage at the VDD pin) monitor. When IRQ3 is enabled (via IRQEN[16]), the PSM
generates an interrupt if the voltage at the VDD pin drops below 6.0 V.
Cleared to 0 to disable the power supply (voltage at the VDD pin) monitor.
2
Low voltage flag (LVF) enable bit.
Set to 1 to enable the LVF function. The low voltage flag can be interrogated via HVMON[3] after power-up to
determine if the REG_DVDD voltage previously dropped below 2.1 V.
Cleared to 0 to disable the LVF function.
1 to 0
LIN operating mode. These bits enable/disable the LIN driver.
00 = LIN disabled.
01 = reserved (not LIN V2.0 compliant).
10 = LIN enabled.
11 = reserved, not used.
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PDF描述 |
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