參數(shù)資料
型號(hào)： ADUC7032BSTZ-8V-RL
廠商： Analog Devices Inc
文件頁數(shù)： 74/128頁
文件大?。?/td> 0K
描述： IC BATTERY SENSOR PREC 48-LQFP
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲(chǔ)器容量： 96KB（48K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1.5K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 48-LQFP
包裝： 標(biāo)準(zhǔn)包裝
其它名稱： ADUC7032BSTZ-8V-RLDKR
Preliminary Technical Data
ADuC7032
Rev. PrD | Page 5 of 128
ADUC7032 DATASHEET TABLES
Table 1 : ADUC7032—SPECIFICATIONS
8
Table 2 : SPI Master Mode Timing (PHASE Mode = 1)
15
Table 3 : SPI Master Mode Timing (PHASE Mode = 0)
16
Table 4 : SPI Slave Mode Timing (PHASE Mode = 1)
17
Table 5 : SPI Slave Mode Timing (PHASE Mode = 0)
18
Table 6. Absolute Maximum Ratings (TA = -40°C to 105°C
unless otherwise noted)
22
Table 7: Pin Function Descriptions
23
Table 8: SYSMAP0 MMR Bit Designations
29
Table 9 : Device RESET Implications
30
Table 10: RSTSTA/RSTCLR MMR Bit Designations
30
Table 11: Command Codes in FEE0CON and FEE1CON
32
Table 12: FEE0STA and FEE1STA MMR bit designations
33
Table 13: FEE0MOD and FEE1MOD MMR bit designations 34
Table 14: FEE0HID and FEE0PRO MMR bit designations
35
Table 15: FEE1HID and FEE1PRO MMR bit designations
35
Table 16: Typical execution cycles in ARM/Thumb mode
37
Table 17 : Complete MMR List
41
Table 18 : GND_SW Configuration
47
Table 19 : Current Channel ADC, Normal Power Mode, Typical
Output RMS Noise (V)
48
Table 20 : Voltage Channel ADC, Typical Output RMS Noise
(referred to ADC Voltage attenuator Input)(V)
48
Table 21 : Temperature Channel ADC, Typical Output RMS
Noise (V)
48
Table 22 : ADCSTA MMR Bit Designations
49
Table 23 : ADCMDE MMR Bit Designations
51
Table 24 : ADC0CON MMR Bit Designations
52
Table 25 : ADC1CON MMR Bit Designations
53
Table 26 : ADC2CON MMR Bit Designations
54
Table 27 : ADCFLT MMR Bit Designations
55
Table 28 : ADC Conversion Rates and Settling Times
56
Table 29 : Allowable Combinations of SF and AF
56
Table 30: ADCCFG MMR Bit Designations
57
Table 31 : Allowable Combinations of SF and AF
61
Table 32 : Common ADCFLT Configurations
63
Table 33: Current ADC Diagnostics
66
Table 34: Temperature ADC Diagnostics
66
Table 35 : PLLSTA MMR Bit Description
69
Table 36: PLLCON MMR Bit description
70
Table 37 : POWCON MMR bit designations
71
Table 38 : OSC0TRM MMR Bit Definition
73
Table 39: OSC0CON MMR Bit Definition
73
Table 40 : OSC0STA MMR Bit Definition
74
Table 41 : IRQ/FIQ MMRs bit description
75
Table 42 : SWICFG MMR Bit Descriptions
76
Table 43 : Timer Event Capture
77
Table 44 : T0CON MMR Bit Descriptions
79
Table 45 : T1CON MMR Bit Descriptions
81
Table 46 : T2CON MMR Bit Descriptions
83
Table 47 : T3CON MMR Bit Definition
85
Table 48 : External GPIO Pin to Internal Port Signal
Assignments
87
Table 49 : GP0CON MMR Bit Designations
88
Table 50 : GP1CON MMR Bit Designations
89
Table 51 : GP2CON MMR Bit Designations
89
Table 52 : GP0DAT MMR Bit Descriptions
90
Table 53 : GP1DAT MMR Bit Descriptions
91
Table 54 :GP2DAT MMR Bit Descriptions
92
Table 55 : GP0SET MMR Bit Descriptions
93
Table 56 : GP1SET MMR Bit Descriptions
94
Table 57 : GP2SET MMR Bit Descriptions
94
Table 58 : GP0CLR MMR Bit Descriptions
95
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