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參數(shù)資料
| 型號： | ADSP-BF561 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | 通用總線功能 |
| 英文描述： | Synchronous 4-Bit Up/Down Binary Counters With Dual Clock and Clear 16-PDIP 0 to 70 |
| 中文描述： | 嵌入式Blackfin處理器的對稱多處理器 |
| 文件頁數(shù)： | 44/52頁 |
| 文件大?。?/td> | 508K |
| 代理商： | ADSP-BF561 |
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Rev. PrC
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April 2004
ADSP-BF561
Preliminary Technical Data
CAPACITIVE LOADING
Output delays and holds are based on standard capacitive loads:
30 pF on all pins (see
Figure 26 on Page 44
).
Figure 25
shows
graphically how output delays and holds vary with load capaci-
tance (Note that this graph or derating does not apply to output
disable delays; see
Output Disable Time on Page 43
). The graphs
of
Figure 25
,
Figure 27
and
Figure 28
may not be linear outside
the ranges shown, for Typical Output Delay vs. Load Capaci-
tance and Typical Output Rise Time (10%-90%, V=Min) vs.
Load Capacitance.
Figure 26. Equivalent Device Loading for AC Measurements (Includes All
Fixtures)
Figure 27. Typical Output Rise/Fall Time (10%-90%, Vddext = Max)
1.5V
20pF
TO
OUTPUT
PIN
50
V
LOAD CAPACITANCE - pF
16.0
8.0
00
200
20
40
60
80
100
120
140
160
180
14.0
12.0
4.0
2.0
10.0
6.0
R
(
TBD
Figure 28. Typical Output Rise/Fall Time (10%-90%, Vddext = Min)
LOAD CAPACITANCE - pF
2.0
00
200
20
40
60
80
100
120
140
160
180
3.5
3.0
1.0
0.5
2.5
1.5
R
(
TBD
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ADSP-BF561SBB600 | 功能描述:IC DSP 32BIT 600MHZ 297-BGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:Blackfin® 標(biāo)準(zhǔn)包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時(shí)鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤 |
| ADSP-BF561SBB600 | 制造商:Analog Devices 功能描述:IC MULTIPROCESSOR |
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