參數(shù)資料
型號： ADSP-BF561
廠商： Analog Devices, Inc.
元件分類： 通用總線功能
英文描述： Synchronous 4-Bit Up/Down Binary Counters With Dual Clock and Clear 16-PDIP 0 to 70
中文描述： 嵌入式Blackfin處理器的對稱多處理器
文件頁數(shù)： 25/52頁
文件大小： 508K
代理商： ADSP-BF561
ADSP-BF561
Preliminary Technical Data
Rev. PrC
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Page 25 of 52
|
April 2004
Asynchronous Memory Write Cycle Timing
Table 15. Asynchronous Memory Write Cycle Timing
Parameter
Min
Max
Unit
Timing Requirements
t
SARDY
ARDY Setup Before CLKOUT
4.0
ns
t
HARDY
ARDY Hold After CLKOUT
0.0
ns
Switching Characteristic
t
DDAT
DATA15–0 Disable After CLKOUT
6.0
ns
t
ENDAT
DATA15–0 Enable After CLKOUT
1.0
ns
t
DO
Output Delay After CLKOUT
1
6.0
ns
t
HO
Output Hold After CLKOUT
1
0.8
ns
1
Output pins include AMS3–0, ABE3–0, ADDR25–2, DATA31–0, AOE, AWE.
Figure 9. Asynchronous Memory Write Cycle Timing
t
DO
t
ENDAT
CLKOUT
AMSx
ABE1–0
ADDR19–1
BE, ADDRESS
t
HO
WRITE DATA
t
DDAT
DATA15–0
AWE
t
SARDY
t
HARDY
SETUP
2 CYCLES
PROGRAMMED WRITE
ACCESS 2 CYCLES
ACCESS
EXTENDED
1 CYCLE
HOLD
1 CYCLE
ARDY
t
HO
t
SARDY
t
DO
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PDF描述
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