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參數(shù)資料
| 型號： | AD9995 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | 12-Bit CCD Signal Processor with Precision Timing ⑩ Generator |
| 中文描述： | 12位CCD信號處理器與精密計時⑩發(fā)生器 |
| 文件頁數(shù)： | 49/60頁 |
| 文件大小： | 1593K |
| 代理商： | AD9995 |
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AD9995
–49–
Table XXXV. V-Pattern Group 9 (VPAT9) Register Map (continued)
Data Bit Default
Address Content
79
Value
0
0
0
0
0
0
0
0
0
0
0
0
Register Name
V6TOG1_9
V6TOG2_9
V6TOG3_9
V6TOG4_9
V6TOG1_9
V6TOG2_9
V6TOG3_9
V6TOG4_9
FREEZE1_9
RESUME1_9
FREEZE2_9
RESUME2_9
Description
V5 Toggle Position 1
V5 Toggle Position 2
V5 Toggle Position 3
V5 Toggle Position 4
V6 Toggle Position 1
V6 Toggle Position 2
V6 Toggle Position 3
V6 Toggle Position 4
V1–V6 Freeze Position 1
V1–V6 Resume Position 1
V1–V6 Freeze Position 2
V1–V6 Resume Position 2
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
7A
7B
7C
7D
7E
Table XXXVI. Register Map Selection (SCK Updated Register)
Data Bit Default
Address Content
7F
Value
0
Register Name
BANKSELECT2
Register Description
Register Bank Access from Bank 2 to Bank 1. 0 = Bank 1, 1 = Bank 2.
[0]
Table XXXVII. V-Sequence 0 (VSEQ0) Register Map
Data Bit Default
Address Content
80
Value
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Register Name
HBLKMASK_0
CLPOBPOL_0
PBLKPOL_0
VPATSEL_0
VMASK_0
HBLKALT_0
UNUSED
VPATREPO_0
VPATREPE_0
VPATSTART_0
HDLEN_0
PBLKTOG1_0
PBLKTOG2_0
HBLKTOG1_0
HBLKTOG2_0
HBLKTOG3_0
HBLKTOG4_0
HBLKTOG5_0
HBLKTOG6_0
CLPOBTOG1_0
CLPOBTOG2_0
Description
Masking Polarity during HBLK. H1 [0]. H3 [1].
CLPOB Start Polarity
PBLK Start Polarity
Selected V-Pattern Group for V-Sequence 0
Enable Masking of V-Outputs (Specified by FREEZE/RESUME Registers)
Enable HBLK Alternation
Unused
Number of Selected V-Pattern Group Repetitions for Odd Lines
Number of Selected V-Pattern Group Repetitions for Even Lines
Start Position in the Line for the Selected V-Pattern Group
HD Line Length (Number of Pixels) for V-Sequence 0
PBLK Toggle Position 1 for V-Sequence 0
PBLK Toggle Position 2 for V-Sequence 0
HBLK Toggle Position 1 for V-Sequence 0
HBLK Toggle Position 2 for V-Sequence 0
HBLK Toggle Position 3 for V-Sequence 0
HBLK Toggle Position 4 for V-Sequence 0
HBLK Toggle Position 5 for V-Sequence 0
HBLK Toggle Position 6 for V-Sequence 0
CLPOB Toggle Position 1 for V-Sequence 0
CLPOB Toggle Position 2 for V-Sequence 0
[1:0]
[2]
[3]
[7:4]
[9:8]
[11:10]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
81
82
83
84
85
86
87
REV. 0
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PDF描述 |
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| AD9995KCPZRL7 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Analog Devices 功能描述: |
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