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參數(shù)資料
| 型號： | A1020B-CQ84C |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 547 CLBS, 2000 GATES, 37 MHz, CQFP84 |
| 封裝： | CERAMIC, CQFP-84 |
| 文件頁數(shù)： | 27/54頁 |
| 文件大?。?/td> | 333K |
| 代理商： | A1020B-CQ84C |
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RadTolerant FPGAs
v3.1
1-29
Table 1-22 RT14100A, A14100A I/O and Output Modules
Worst-Case Military Conditions, VCC = 4.5 V, TJ = 125°C
–1 Speed
Std Speed
Parameter
Description
Min.
Max.
Min.
Max.
Units
I/O Module Sequential Timing
tINH
Input Flip-Flop Data Hold
0.0
ns
tINSU
Input Flip-Flop Data Setup
2.1
2.4
ns
tIDEH
Input Data Enable Hold
0.0
ns
tIDESU
Input Data Enable Setup
8.7
10.0
ns
tOUTH
Output Flip-Flop Data Hold
1.2
ns
tOUTSU
Output Flip-Flop Data Setup
1.2
ns
tODEH
Output Data Enable Hold
0.6
ns
tODESU
Output Data Enable Setup
2.4
ns
TTL Output Module Timing1
tDHS
Data-to-Pad, High Slew
7.5
8.9
ns
tDLS
Data-to-Pad, Low Slew
11.9
14.0
ns
tENZHS
Enable-to-Pad, Z to H/L, High Slew
6.0
7.0
ns
tENZLS
Enable-to-Pad, Z to H/L, Low Slew
10.9
12.8
ns
tENHSZ
Enable-to-Pad, H/L to Z, High Slew
11.9
14.0
ns
tENLSZ
Enable-to-Pad, H/L to Z, Low Slew
10.9
12.8
ns
tCKHS
IOCLK Pad-to-Pad H/L, High Slew
12.2
14.0
ns
tCKLS
IOCLK Pad-to-Pad H/L, Low Slew
17.8
ns
dTLHHS
Delta LOW to HIGH, High Slew
0.04
ns/pF
dTLHLS
Delta LOW to HIGH, Low Slew
0.07
0.08
ns/pF
dTHLHS
Delta HIGH to LOW, High Slew
0.05
0.06
ns/pF
dTHLLS
Delta HIGH to LOW, Low Slew
0.07
0.08
ns/pF
CMOS Output Module Timing1
tDHS
Data-to-Pad, High Slew
9.2
10.8
ns
tDLS
Data-to-Pad, Low Slew
17.3
20.3
ns
tENZHS
Enable-to-Pad, Z to H/L, High Slew
7.7
9.1
ns
tENZLS
Enable-to-Pad, Z to H/L, Low Slew
13.1
15.5
ns
tENHSZ
Enable-to-Pad, H/L to Z, High Slew
11.6
14.0
ns
tENLSZ
Enable-to-Pad, H/L to Z, Low Slew
10.9
12.8
ns
tCKHS
IOCLK Pad-to-Pad H/L, High Slew
14.4
16.0
ns
tCKLS
IOCLK Pad-to-Pad H/L, Low Slew
20.2
22.4
ns
dTLHHS
Delta LOW to HIGH, High Slew
0.06
0.07
ns/pF
dTLHLS
Delta LOW to HIGH, Low Slew
0.11
0.13
ns/pF
dTHLHS
Delta HIGH to LOW, High Slew
0.04
0.05
ns/pF
dTHLLS
Delta HIGH to LOW, Low Slew
0.05
0.06
ns/pF
Note:
1. Delays based on 35 pF loading.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A14100A-1CQ256B | FPGA, 1377 CLBS, 30000 GATES, 100 MHz, CQFP256 |
| A1280A-1CQ172E | FPGA, 1232 CLBS, 8000 GATES, 60 MHz, CQFP172 |
| A1460A-1CQ196E | FPGA, 848 CLBS, 6000 GATES, 100 MHz, CQFP196 |
| A1460A-1PG207E | FPGA, 848 CLBS, 6000 GATES, 100 MHz, CPGA207 |
| A1460A-CQ196E | FPGA, 848 CLBS, 6000 GATES, 85 MHz, CQFP196 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A1020B-CQ84E | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A1020B-CQ84M | 制造商:Microsemi Corporation 功能描述:IC FPGA 2K GATES 84-CQFP MIL 制造商:Microsemi Corporation 功能描述:IC FPGA 69 I/O 84CQFP |
| A1020B-PG84B | 制造商:Microsemi SOC Products Group 功能描述:FPGA ACT 1 2K GATES 547 CELLS 48MHZ 1.0UM 5V 84CPGA - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 2K GATES 84-CPGA MIL |
| A1020B-PG84C | 功能描述:IC FPGA 2K GATES 84-CPGA COM RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:ACT™ 1 標(biāo)準(zhǔn)包裝:1 系列:ProASICPLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):129024 輸入/輸出數(shù):248 門數(shù):600000 電源電壓:2.3 V ~ 2.7 V 安裝類型:表面貼裝 工作溫度:- 封裝/外殼:352-BFCQFP，帶拉桿 供應(yīng)商設(shè)備封裝:352-CQFP（75x75） |
| A1020B-PG84E | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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