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參數(shù)資料
| 型號(hào)： | UPD6708CX |
| 廠商： | NEC Corp. |
| 英文描述： | IEBusa Inter Equipment Busa PROTOCOL CONTROL LSI |
| 中文描述： | IEBusa設(shè)備布薩間協(xié)議控制大規(guī)模集成電路 |
| 文件頁數(shù)： | 19/72頁 |
| 文件大?。?/td> | 292K |
| 代理商： | UPD6708CX |
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19
μ
PD6708
2.5
Bit Format
The IEBus communication frame bit format (concept) is shown in Figure 2-4.
Figure 2-4. IEBus Bit Format (Concept)
Logic “1”: Potential difference between bus lines (BUS+ pin and BUS– pin) is 20 mV or lower (low level).
Logic “0”: Potential difference between bus lines (BUS+ pin and BUS– pin) is 120 mV or higher (high level).
Preparation period:
Synchronous period: The next high-level (logic “0”) period
Data period:
The period that expresses the bit value (logic “1”: low level; logic “0”: high level)
The first or subsequent low-level (logic “1”) period
The synchronous period and data period have approximately the same length.
The IEBus uses bit-by-bit synchronization. The specifications for the total bit time and the periods allocated to the bits
depend on the type of transfer bit, and on whether the unit is the master unit or the slave unit.
#
Preparation Period
Synchronous Period
Data Period
Logic "1"
Logic "0"
Preparation Period
Synchronous Period
Data Period
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD6708GS | IEBusa Inter Equipment Busa PROTOCOL CONTROL LSI |
| UPD6951 | 6 BIT D/A CONVERTER FOR VIDEO SIGNAL PROCESSING CMOS LSI |
| UPD6951C | 6 BIT D/A CONVERTER FOR VIDEO SIGNAL PROCESSING CMOS LSI |
| UPD6951G | 6 BIT D/A CONVERTER FOR VIDEO SIGNAL PROCESSING CMOS LSI |
| UPD703130GC-8EU | MOS INTEGRATED CIRCUIT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD6708GS | 制造商:NEC 制造商全稱:NEC 功能描述:IEBusa Inter Equipment Busa PROTOCOL CONTROL LSI |
| UPD6708GS(A) | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD67100 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| UPD67101 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| UPD67240 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
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