參數(shù)資料
型號(hào)： SME5434PCI-440
元件分類： 微控制器/微處理器
英文描述： 64-BIT, 440 MHz, RISC PROCESSOR, XMA
封裝： 130 X 100 MM, 45 MM HEIGHT MODULE
文件頁(yè)數(shù)： 15/30頁(yè)
文件大小： 393K
代理商： SME5434PCI-440
22
SME5431PCI-360
SME5434PCI-440
Preliminary
360/440MHz CPU; 0.25 to 2 MB L2 cache; UPA64S, 66MHz PCI Interfaces
UltraSPARC IIi CPU Module
September 2001
Sun Microsystems, Inc
TESTABILITY INTERFACE (JTAG)
These UltraSPARC-IIi CPU modules implement the IEEE 1149.1 standard to aid board level testing. Boundary
Scan Description Language (BSDL) is available for the device.
JTAG Timing
Figure 6. Voltage Waveforms - Setup and Hold Times
Figure 7. Voltage Waveforms - Propagation Delay Times
AC Characteristics - JTAG Timing (estimated values)
Symbol
Parameter
Signals
Conditions
Min
Typ
Max
Units
tW (TRST)
Test reset pulse width
TRST [1]
1. TRST is an asynchronous reset.
5––ns
tSU (TDI)
Input setup time to TCK
TDI
–3–ns
tSU (TMS)
Input setup time to TCK
TMS
–4–ns
tH(TDI)
Input hold time to TCK
TDI
–
1.5
–
ns
tH(TMS)
Input hold time to TCK
TMS
–
1.5
–
ns
tPD(TDO)
Output delay from TCK [2]
2. TDO is referenced from falling edge of TCK.
TDO
IOL = 8 mA
IOH = -4 mA
CL = 35 pF
VLOAD = 1.5 V
–6–ns
tOH(TDO)
Output hold time from TCK [2]
TDO
3––ns
TDI, TMS
tH
1.5V
VIH
VIL
Clock
tSU
2.0V
VIH
VIL
1.5V
Clock
tPD
TDO
2.0V
VIH
VIL
VOH
VOL
tOH
0.8V
相關(guān)PDF資料
PDF描述
SME5434PCI-480 64-BIT, 480 MHz, RISC PROCESSOR, XMA
SMFR-29C516ESC 16-BIT ERROR DETECT AND CORRECT CKT, QFP100
SMJ320C26FJ 16-BIT, 40 MHz, OTHER DSP, CQCC68
SMJ320C31KGDM40B 32-BIT, 40 MHz, OTHER DSP, UUC132
SMJ320C40KGDS50C 32-BIT, 50 MHz, OTHER DSP, UUC325
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參數(shù)描述
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