- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383735 > P9S12XEP100J1CAG (飛思卡爾半導(dǎo)體(中國(guó))有限公司) Microcontrollers PDF資料下載
參數(shù)資料
| 型號(hào)： | P9S12XEP100J1CAG |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 225/1036頁(yè) |
| 文件大小： | 3356K |
| 代理商： | P9S12XEP100J1CAG |
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MC9S12XE-Family Reference Manual , Rev. 1.07
Freescale Semiconductor
225
Chapter 4
Memory Protection Unit (S12XMPUV1)
Table 4-1. Revision History
4.1
Introduction
The MPU module provides basic functionality required to protect memory mapped resources from
undesired accesses. Multiple address range comparators compare memory accesses against eight memory
protection descriptors located in the MPU module to determine if each access is valid or not. The
comparison is sensitive to which bus master generates the access and the type of the access.
The MPU module can be used to isolate memory ranges accessible by different bus masters. It can be also
be used by an operating system or software kernel to isolate the regions of memory “l(fā)egally” available to
specific software tasks, with the kernel re-configuring the task specific memory protection descriptors in
supervisor state during task-switching.
4.1.1
Preface
The following terms and abbreviations are used in the document.
Table 4-2. Terminology
Version
Number
Revision
Date
Effective
Date
Author
Description of Changes
01.04
14 Sep
2005
14 Sep
2005
- added note to only use the CPU to clear the AE flag.
- added disclaimer to avoid changing descriptors while they are in
use because of other bus-masters doing accesses
- clarified that interrupt generation is independent of AEF bit state
- corrected preliminary statement about execution of violating
accesses
01.05
14 Mar
2006
14 Mar
2006
01.06
09 Oct
2006
09 Oct
2006
- made Revision History entries public
Term
MCU
MPU
CPU
XGATE
Meaning
Micro-Controller Unit
Memory Protection Unit
S12X Central Processing Unit (see S12XCPU Reference Manual)
XGATE Co-processor (see XGATE chapter)
supervisor state
user state
refers to the supervisor state of the S12XCPU (see S12XCPU Reference Manual)
refers to the user state of the S12XCPU (see S12XCPU Reference Manual)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| P9S12XEP100J1CAGR | Microcontrollers |
| P9S12XEP100J1CAL | Microcontrollers |
| P9S12XEP100J1CALR | Microcontrollers |
| P9S12XEP100J1CVL | Microcontrollers |
| P9S12XEP100J1CVLR | Microcontrollers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| P9S12XEP100J1CAGR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1CAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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| P9S12XEP100J1CVL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1CVLR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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