參數(shù)資料
型號(hào)： P89CV51RC2FA,512
廠商： NXP Semiconductors
文件頁數(shù)： 63/76頁
文件大?。?/td> 0K
描述： IC 80C51 MCU FLASH 32K 44-PLCC
產(chǎn)品培訓(xùn)模塊： Migrating from 8/16-Bit MCUs to 32-Bit ARMs
標(biāo)準(zhǔn)包裝： 26
系列： 89C
核心處理器： 8051
芯體尺寸： 8-位
速度： 40MHz
連通性： EBI/EMI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 32
程序存儲(chǔ)器容量： 32KB（32K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-LCC（J 形引線）
包裝： 管件
其它名稱： 568-4254-5
935284108512
P89CV51RC2FA
P89CV51RB2_RC2_RD2_3
NXP B.V. 2009. All rights reserved.
Product data sheet
Rev. 03 — 25 August 2009
66 of 76
NXP Semiconductors
P89CV51RB2/RC2/RD2
80C51 with 1 kB RAM, SPI
Fig 33. Shift register mode timing waveforms
002aaa552
ALE
0
instruction
1
2
3
4
5
6
7
8
01
2
3
4
5
6
7
valid
TXLXL
set TI
set RI
tXHQX
tQVXH
tXHDV
tXHDX
clock
output data
write to SBUF
input data
clear RI
Table 58.
SPI interface timing
Symbol
Parameter
Conditions
Variable clock
fosc =18MHz
Unit
Min
Max
Min
Max
fSPI
SPI operating frequency
0
Tcy(clk) / 4
0
10
MHz
TSPICYC
SPI cycle time
4Tcy(clk)
-
222
-
ns
tSPILEAD
SPI enable lead time
250
-
250
-
ns
tSPILAG
SPI enable lag time
250
-
250
-
ns
tSPICLKH
SPICLK HIGH time
2Tcy(clk)
-
111
-
ns
tSPICLKL
SPICLK LOW time
2Tcy(clk)
-
111
-
ns
tSPIDSU
SPI data set-up time
master or slave;
100
-
100
-
ns
tSPIDH
SPI data hold time
master or slave;
100
-
100
-
ns
tSPIA
SPI access time
0
80
0
80
ns
tSPIDIS
SPI disable time
0
160
-
160
ns
tSPIDV
SPI enable to output data
valid time
-
111
-
111
ns
tSPIOH
SPI output data hold time
0-
0
-
ns
tSPIR
SPI rise time
SPI outputs (SPICLK, MOSI,
MISO)
-
100
-
100
ns
SPI inputs (SPICLK, MOSI,
MISO, SS)
-
2000
-
2000
ns
tSPIF
SPI fall time
SPI outputs (SPICLK, MOSI,
MISO)
-
100
-
100
ns
SPI inputs (SPICLK, MOSI,
MISO, SS)
-
2000
-
2000
ns
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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