參數(shù)資料
型號： P89CV51RC2FA,512
廠商： NXP Semiconductors
文件頁數(shù)： 24/76頁
文件大?。?/td> 0K
描述： IC 80C51 MCU FLASH 32K 44-PLCC
產(chǎn)品培訓模塊： Migrating from 8/16-Bit MCUs to 32-Bit ARMs
標準包裝： 26
系列： 89C
核心處理器： 8051
芯體尺寸： 8-位
速度： 40MHz
連通性： EBI/EMI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 32
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-LCC（J 形引線）
包裝： 管件
其它名稱： 568-4254-5
935284108512
P89CV51RC2FA
P89CV51RB2_RC2_RD2_3
NXP B.V. 2009. All rights reserved.
Product data sheet
Rev. 03 — 25 August 2009
30 of 76
NXP Semiconductors
P89CV51RB2/RC2/RD2
80C51 with 1 kB RAM, SPI
6.5 Timer 2
Timer 2 is a 16-bit timer/counter which can operate as either an event timer or an event
counter, as selected by C/T2 in the special function register T2CON. Timer 2 has four
operating modes: Capture, Auto-reload (up or down counting), Clock-out, and Baud rate
generator which are selected according to Table 18 using T2CON (Table 19 and Table 20)
and T2MOD (Table 21 and Table 22).
Fig 10. Timer/counter 0 Mode 3 (two 8-bit counters)
002aaa522
osc/2
TR1
TR0
TnGate
INT0 pin
TL0
(8-bits)
TF0
control
overflow
interrupt
TH0
(8-bits)
TF1
control
overflow
interrupt
osc/6
T0 pin
C/T = 0
C/T = 1
Table 18.
Timer 2 operating mode
RCLK + TCLK
CP/RL2
TR2
T2OE
Mode
0
1
0
16-bit auto reload
0
1
0
16-bit capture
0
1
Programmable clock-out
1
X
1
0
Baud rate generator
X
0
X
off
Table 19.
T2CON - Timer/Counter 2 control register (address C8H) bit allocation
Bit addressable; reset value: 00H.
Bit
7
6
5
4
3
2
1
0
Symbol
TF2
EXF2
RCLK
TCLK
EXEN2
TR2
C/T2
CP/RL2
Table 20.
T2CON - Timer/Counter 2 control register (address C8H) bit description
Bit
Symbol
Description
7
TF2
Timer 2 overow ag set by a Timer 2 overow and must be cleared by
software. TF2 will not be set when either RCLK or TCLK = 1 or when Timer
2 is in Clock-out mode.
6
EXF2
Timer 2 external ag is set when Timer 2 is in capture, reload or baud rate
mode, EXEN2 = 1 and a negative transition on T2EX occurs. If Timer 2
interrupt is enabled EXF2 = 1 causes the CPU to vector to the Timer 2
interrupt routine. EXF2 must be cleared by software.
5
RCLK
Receive clock ag. When set, causes the UART to use Timer 2 overow
pulses for its receive clock in modes 1 and 3. RCLK = 0 causes Timer 1
overow to be used for the receive clock.
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