參數(shù)資料
型號(hào)： MT9088IG
廠商： Zarlink Semiconductor Inc.
英文描述： TDM to Packet Processors
中文描述： TDM到分組處理器
文件頁(yè)數(shù)： 90/97頁(yè)
文件大?。?/td> 702K
代理商： MT9088IG
MT90880/1/2/3
Data Sheet
90
Zarlink Semiconductor Inc.
10.3.3 RMII Interface
10.4 External Memory Interface
Table 37 - External Memory Timing
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
Clock Frequency
50
MHz
±
50 ppm
Clock Duty Cycle
35
65
%
Setup Time to Clock Rising Edge
RXD[1:0], CRS_DV
t
S
4
ns
Hold Time from Clock Rising Edge
RXD[1:0], CRS_DV
t
H
2
ns
TXD[1:0] TX_EN Output delay
t
DV
14
ns
Table 36 - Packet Interface Timing - RMII Interface
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
S_CLK to Data Out Valid Delay
(RAM_D)
T
RDV
10
ns
S_CLK to Signal Valid Delay
(RAM_A, RAM_ADSC#, RAM_RW,
RAM_OE)
T
RAV
7.5
ns
RAM_D setup time before S_CLK
rising edge
T
RDS
3
ns
RAM_D hold time after S_CLK
rising
T
RDH
0
ns
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PDF描述
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