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參數資料
| 型號： | MT90520AG |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數字傳輸電路 |
| 英文描述： | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA456 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, PLASTIC, MS-034, BGA-456 |
| 文件頁數： | 1/180頁 |
| 文件大?。?/td> | 1736K |
| 代理商： | MT90520AG |
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Zarlink Semiconductor Inc.
Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.
Copyright 2002-2004, Zarlink Semiconductor Inc. All Rights Reserved.
Features
AAL1 Segmentation and Reassembly device
compliant with Circuit Emulation Services (CES)
standard (af-vtoa-0078.000)
Supports both Unstructured and Structured
Circuit Emulation of 8 independent DS1/E1/ST-
BUS interfaces
Supports AAL1 trunking, with up to 128 TDM
channels per VC (af-vtoa-0089.001)
Supports CAS transmission and reception in all
structured modes of operation
Supports simultaneous processing of up to 256
bidirectional Virtual Circuits
Supports mixed DS1/E1 operation
Supports mixed Unstructured and Structured CES
operation
Fully flexible DS0 assignment
Complete clock recovery solution provided on-
chip: Synchronous, Adaptive, or Synchronous
Residual Time Stamp (SRTS) via 8 independent
PLLs
Dual-mode (ATM-end or PHY-end) UTOPIA port
operates in Level 1 or Level 2 mode for
connection to external PHY or ATM devices with
UTOPIA clock rate up to 52 MHz
TDM bus provides 8 bidirectional serial streams
at 1.544, 2.048, or 4.096 MHz - compatible with
Generic (1.544 Mbps or 2.048 Mbps) and ST-
BUS (2.048 Mbps) interfaces
Supports master and slave TDM backplane bus
clock operation
Supports TDM and UTOPIA loopback functions
16-bit microprocessor port, configurable to
Motorola or Intel timing
Master clock rate of 66.0 MHz
Figure 1 - MT90520 Block Diagram
Segmentation / Reassembly
Circular Buffers
VC Look-Up
Table
External
Synchronous
SRAM (ZBT)
External Memory Controller
UTOPIA
INPUT
BLOCK
JTAG
Interface
16-bit Microprocessor
Interface
Boundary-
Scan Logic
Microprocessor
Interface Logic
UTOPIA
Interface
UTOPIA
OUTPUT
BLOCK
Local
Memory
TDM
INPUT
BLOCK
Tx/Segmentation (X 8)
TX
SAR
Local
Memory
TDM
OUTPUT
BLOCK
RX SARs
(UDT, SDT,
Data)
Rx/Reassembly (X 8)
PLL
Clock
Management
TDM Input
Interface
TDM Output
Interface
MT90520
Clock Control
/Recovery
Interface
January 2004
Ordering Information
MT90520AG
456 Pin Plastic BGA
-40 to +85°C
MT90520
8-Port Primary Rate
Circuit Emulation AAL1 SAR
Data Sheet
相關PDF資料 |
PDF描述 |
|---|---|
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AV | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90820 | Large Digital Switch |
| MT90820AL | Large Digital Switch |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MT90520AG2 | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90528 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90528AG | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90528AG2 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90710 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:High-Speed Isochronous Multiplexer |
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