參數(shù)資料
型號(hào)： MPC509
廠商： MOTOROLA INC
元件分類(lèi)： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁(yè)數(shù)： 105/300頁(yè)
文件大?。?/td> 3744K
代理商： MPC509
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MPC509
USER’S MANUAL
SYSTEM INTERFACE UNIT
Rev. 15 June 98
MOTOROLA
5-11
to-external cycles are not pipelined with cross-bus accesses, nor are two consecutive
cross-bus accesses pipelined.
Clearing the L-bus to I-bus cross-bus access (LIX) bit in the MEMMAP register dis-
ables data accesses to I-bus memory. This allows load/store data stored in a flash
memory on the I-bus to be moved off-chip for development purposes. When this bit is
cleared, L-bus to I-bus transactions are run externally.
5.3.5 Response to Freeze Assertion
The RCPU asserts the freeze signal to the rest of the MCU when one of the following
conditions occurs:
Debug mode is entered; or
A software debug monitor program is entered as the result of an exception when
the associated bit in the debug enable register (DER, SPR149) is set.
The following paragraphs explain how the assertion of the freeze signal affects the
SIU. See
SECTION 8 DEVELOPMENT SUPPORT
for additional details on this signal.
5.3.5.1 Effects of Freeze and Debug Mode on the Bus Monitor
When the freeze signal is asserted and debug mode is disabled, the bus monitor is
unaffected. This means that a software monitor must configure the bus monitor to pro-
vide protection from unterminated bus cycles that occur during debugging.
When the processor is in debug mode (debug mode is enabled and the freeze signal
is asserted), the bus monitor is enabled. The bus monitor is also enabled when debug
mode is enabled and a non-maskable breakpoint is asserted by the development port.
These enables override the bus monitor enable bit (BME) in the bus monitor control
register (BMCR) in the SIU. In both cases the bus monitor time-out period is whatever
was programmed in the BMCR. This override allows an external development tool to
retain control over the CPU in debug mode by not allowing an external bus cycle to
hang the processor in an endless wait for a transfer acknowledge.
In addition, if the processor is executing normally and runs a bus cycle that is not ter-
minated, a non-maskable breakpoint always gains control of the processor by
terminating the bus cycle with the bus monitor so the processor can enter debug
mode. In this case, the non-maskable breakpoint is not restartable. The processor
takes the breakpoint before completing the prologue of the exception handler called
as a result of the bus monitor.
5.3.5.2 Effects of Freeze on the Programmable Interrupt Timer (PIT)
When freeze is asserted and the SIU freeze bit (SIUFRZ) is set in the SIU module con-
figuration register (SIUMCR), the PIT is disabled. This disable overrides the periodic
interrupt enable bit (PIE) in the periodic interrupt control and select register (PICSR)
in the SIU. This allows the count in the PIT to be preserved when execution stops.
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MPC509AU 功能描述:多路器開(kāi)關(guān) IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數(shù)量:1 開(kāi)關(guān)數(shù)量:4 開(kāi)啟電阻（最大值）:7 Ohms 開(kāi)啟時(shí)間（最大值）: 關(guān)閉時(shí)間（最大值）: 傳播延遲時(shí)間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:UQFN-16
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