(8) I2C Timing (Vcc = 5.0 V ± 10%, AVss = Vs" />
參數(shù)資料
型號： MB95F118JWPMC-GE1
廠商： Fujitsu Semiconductor America Inc
文件頁數(shù)： 48/76頁
文件大?。?/td> 0K
描述： IC MCU 60K FLASH 2KB RAM 52LQFP
標(biāo)準(zhǔn)包裝： 1
系列： F²MC MB95110M
核心處理器： F²MC-8FX
芯體尺寸： 8-位
速度： 16MHz
連通性： I²C，LIN，SIO，UART/USART
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 39
程序存儲器容量： 60KB（60K x 8）
程序存儲器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x8/10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 52-LQFP
包裝： 托盤
產(chǎn)品目錄頁面： 722 (CN2011-ZH PDF)
其它名稱： 865-1071
MB95110M Series
52
(8) I2C Timing
(Vcc
= 5.0 V ± 10%, AVss = Vss = 0.0 V, TA = 40 °C to + 85 °C)
*1 : R, C : Pull-up resistor and load capacitor of the SCL and SDA lines.
*2 : The maximum tHD;DAT have only to be met if the device dose not stretch the “L” width (tLOW) of the SCL signal.
*3 : A fast-mode I2C-bus device can be used in a standard-mode I2C-bus system, but the requirement
tSU;DAT
≥ 250 ns must then be met.
Parameter
Symbol
Pin
name
Conditions
Value
Unit
Standard
mode
Fast
mode
Min
Max
Min
Max
SCL clock frequency
fSCL
SCL0
R
= 1.7 k,
C
= 50 pF*1
0
100
0
400
kHz
(Repeat) Start condition hold time
SDA
↓ → SCL ↓
tHD;STA
SCL0
SDA0
4.0
0.6
s
SCL clock “L” width
tLOW
SCL0
4.7
1.3
s
SCL clock “H” width
tHIGH
SCL0
4.0
0.6
s
(Repeat) Start condition setup time
SCL
↑ → SDA ↓
tSU;STA
SCL0
SDA0
4.7
0.6
s
Data hold time SCL
↓ → SDA ↓ ↑
tHD;DAT
SCL0
SDA0
0
3.45*2
00.9*3
s
Data setup time SDA
↓ ↑ → SCL ↑ tSU;DAT
SCL0
SDA0
0.25
0.1
s
Stop condition setup time SCL
↑ →
SDA
↑
tSU;STO
SCL0
SDA0
4
0.6
s
Bus free time between stop
condition and start condition
tBUF
SCL0
SDA0
4.7
1.3
s
SDA0
SCL0
tWAKEUP
tHD;STA
tSU;DAT
tHD;STA
tSU;STA
tLOW
tHD;DAT
tHIGH
tSU;STO
tBUF
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PDF描述
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