參數(shù)資料
型號： HM5212165F
廠商： Hitachi,Ltd.
英文描述： 128M LVTTL interface SDRAM(128M LVTTL 接口同步DRAM)
中文描述： 128M的LVTTL接口的SDRAM（128M的LVTTL接口同步的DRAM）
文件頁數(shù)： 59/63頁
文件大?。?/td> 858K
代理商： HM5212165F
59
Clock Suspend Mode
D
E
M
N
'
(
/
0
9
(
L
M
<
D
E
L
M
!
*
+
2
3
+
3
4
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=
GH
0
1
2
3
4
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6
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8
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11
12
13
14
15
16
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18
19
20
P
K
"
+
4
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)
*
2
3
+
,
4
R:a
C:a
R:b
a
a+1 a+2
a+3
b
b+1 b+2
!
"
*
+
H
R:a
C:a R:b
C:b
H
P
H
a
a+1 a+2
b
b+1 b+2 b+3
&
BS
"
*
+
H
C:b
B
K
L
Bank0
Active
Active clock
suspend start
Active clock
supend end
Bank0
Bank3
Active
Read suspend
start
Read suspend
end
Bank0
Precharge
Bank3
Read
Earliest Bank3
Precharge
Bank0
Write
Bank0
Active clock
Active clock
Bank3
Write suspend
start
Write suspend
end
Bank3
Write
Bank0
Precharge
Earliest Bank3
Precharge
L
L
K
L
b+3
+
3
4
<
*
+
3
<
;
<
D
L
M
;
<
C
D
L
2
:
;
C
D
L
2
:
;
B
C
L
7
8
@
H
I
%
.
6
7
H
.
6
7
@
H
7
8
@
A
H
I
'
(
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0
8
&
'
/
0
8
&
.
/
.
7
8
@
H
&
'
.
/
8
%
&
%
CKE
RAS
CS
CAS
WE
Address
DQMU/DQML
DQ (output)
DQ (input)
CLK
BS
CKE
RAS
CS
CAS
Address
DQM,
DQMU/DQML
DQ (output)
DQ (input)
a+3
High-Z
High-Z
"
#
,
5
=
>
(
)
1
2
9
:
B
K
.
/
7
8
@
t
CES
t
CEH
t
CES
Read cycle
RAS
-
CAS
delay = 2
CAS
latency = 2
Burst length = 4
= V or V
IL
Write cycle
RAS
-
CAS
delay = 2
CAS
latency = 2
Burst length = 4
= V or V
IH
IL
7
8
@
A
H
I
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