參數(shù)資料
型號: EP20K60ETI144-3ES
元件分類: 電源監(jiān)測
英文描述: Dual Voltage Monitor with Intergrated CPU Supervisor
中文描述: 雙電壓監(jiān)視器集成CPU監(jiān)控
文件頁數(shù): 87/114頁
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代理商: EP20K60ETI144-3ES
74
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Figure 39. ESB Synchronous Timing Waveforms
Figure 40 shows the timing model for bidirectional I/O pin timing.
WE
CLK
ESB Synchronous Read
a0
d2
tESBDATASU
tESBARC
tESBDATACO2
a1
a2
a3
d1
tESBDATAH
a0
WE
CLK
dout0
din1
din2
din3
din2
tESBWESU
tESBSWC
tESBWEH
tESBDATACO1
a1
a2
a3
a2
din3
din2
din1
tESBDATAH
tESBDATASU
ESB Synchronous Write (ESB Output Registers Used)
dout1
Rdaddress
Data-Out
Wraddress
Data-Out
Data-In
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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