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參數(shù)資料
| 型號： | AFE7222IRGC25 |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 88/106頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC AFE 12BIT 65/130MSPS 64VQFN |
| 標準包裝： | 1 |
| 位數(shù)： | 12 |
| 通道數(shù)： | 4 |
| 功率（瓦特）： | 610mW |
| 電壓 - 電源，模擬： | 2.85 V ~ 3.6 V |
| 電壓 - 電源，數(shù)字： | 1.7 V ~ 1.9 V |
| 封裝/外殼： | 64-VFQFN 裸露焊盤 |
| 供應商設(shè)備封裝： | 64-VQFN 裸露焊盤（9x9） |
| 包裝： | 標準包裝 |
| 其它名稱： | 296-30067-6 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁當前第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁
ADC_DCLKOUT
ADCDATA <11:0>
A
B
A
B
A
B
ADC_DCLKOUT
ADCDATA <11:0>
A
B
A
th
tsu
th
tsu
tCLK
SLOS711B – NOVEMBER 2011 – REVISED MARCH 2012
Table 10-2 shows the maximum frequency of operation of various clocks of AFE7225 in CMOS interface
mode (by default after reset, AFE722x operates in CMOS interface mode for both RX and TX path).
Table 10-2. Maximum Interface Rates in CMOS Mode
RX PATH
Decimation Factor
Low Power CMOS Mode
Max ADC Sampling Clock
(register bits
Max ADC_DCLKOUT
Max Parallel Output Data Rate
(register bit
(ADC_CLK(1))
RX_DEC_FIL_EN,
MHz
Mbps, per pin
MODE_LP_CMOS)
MHz
RX_DEC_FIL_EN_SRC)
1
105
210
Disabled (default)
105
2
52.5
105
1
40
80
Enabled
40
2
20
40
TX PATH
Interpolation Factor
Max DAC Output Clock
(register bits
Max DAC_DCLKIN
Max Parallel Input Data Rate
(DAC_CLK(1))
TX_INT_MODE(1:0),
MHz
Mbps, per pin
MHz
TX_INT_MODE_SRC)
1
130
260
2
130
65
130
4
32.5
65
(1)
ADC_CLK and DAC_CLK are derived from clocks on CLKINP and CLKINN (differential clock, a single-ended clock or two independent
single-ended clocks). See Clocking section for details. For Full-Duplex operation requiring two single-ended clocks, see section Full
10.1 PARALLEL CMOS ADC RX DATA
The 12-bit ADC-A and ADC-B data is interleaved (A then B) into one 12-bit word on pins
ADCDATA0:ADCDATA11 at twice the rate of each pattern with a DDR clock (data transitions on rising
and falling edges). This can be quadrature data or two independent receive channels. Note that in the
default RX CMOS mode, the edges of the ADC_DCLKOUT are aligned in the middle of the data window.
Figure 10-1. RX CMOS Interleaved Output
10.2 TIMING INFORMATION FOR PARALLEL CMOS ADC RX DATA
tCLK = Time period of ADC output data clock (same as time period of ADC sampling clock when decimation is set to
1).
Figure 10-2. RX CMOS Output Timing
82
DIGITAL INTERFACE
Copyright 2011–2012, Texas Instruments Incorporated
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V48C2M50BF | CONVERTER MOD DC/DC 2V 50W |
| VE-J6D-MW-F3 | CONVERTER MOD DC/DC 85V 100W |
| V48C2M50BL3 | CONVERTER MOD DC/DC 2V 50W |
| VE-J6D-MW-F2 | CONVERTER MOD DC/DC 85V 100W |
| B37872K0474K062 | CAP CER 0.47UF 25V 10% X7R 1206 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AFE7222IRGCR | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數(shù)據(jù)速率:54 Mbps 噪聲系數(shù): 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7222IRGCT | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數(shù)據(jù)速率:54 Mbps 噪聲系數(shù): 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7225 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Analog Front End Wideband Mixed-Signal Transceiver |
| AFE7225EVM | 功能描述:射頻開發(fā)工具 AFE7225 Eval Mod RoHS:否 制造商:Taiyo Yuden 產(chǎn)品:Wireless Modules 類型:Wireless Audio 工具用于評估:WYSAAVDX7 頻率: 工作電源電壓:3.4 V to 5.5 V |
| AFE7225IRGC25 | 功能描述:射頻前端 Dual 12B,125MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數(shù)據(jù)速率:54 Mbps 噪聲系數(shù): 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-32 |
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