VLOAD
參數(shù)資料
型號(hào): ADSP-3PARCBF548M01
廠商: Analog Devices Inc
文件頁(yè)數(shù): 89/100頁(yè)
文件大?。?/td> 0K
描述: MODULE BOARD BF548
產(chǎn)品培訓(xùn)模塊: Arcturus uCBF54x-EMM
特色產(chǎn)品: uCBF54x Start Kit and System Module by Arcturus
標(biāo)準(zhǔn)包裝: 5
系列: Blackfin®
模塊/板類(lèi)型: 處理器模塊
適用于相關(guān)產(chǎn)品: ADSP-BF548
相關(guān)產(chǎn)品: ADSP-BF548MBBCZ-5M-ND - IC DSP 533MHZ W/DDR 400CSPBGA
ADSP-BF548BBCZ-5A-ND - IC DSP 16BIT 533MHZ 400CSBGA
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
VLOAD is equal to VDDEXT/2 or VDDDDR/2, depending on the pin
under test. Figure 74 through Figure 85 on Page 91 show how
output rise time varies with capacitance. The delay and hold
specifications given should be derated by a factor derived from
these figures. The graphs in these figures may not be linear out-
side the ranges shown.
TYPICAL RISE AND FALL TIMES
Figure 74. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver A at VDDEXT = 2.25 V
Figure 75. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver A at VDDEXT = 3.65 V
LOAD CAPACITANCE (pF)
RISE TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
14
12
10
8
6
4
2
0
50
100
150
200
250
FALL TIME
LOAD CAPACITANCE (pF)
RISE TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
12
10
8
6
4
2
0
50
100
150
200
250
FALL TIME
Figure 76. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver B at VDDEXT = 2.25 V
Figure 77. Typical Rise and Fall Times (10% to 90%) vs. Load Capacitance for
Driver B at VDDEXT = 3.65 V
LOAD CAPACITANCE (pF)
RISE TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
12
10
8
6
4
2
0
50
100
150
200
250
FALL TIME
LOAD CAPACITANCE (pF)
RISE TIME
RISE
AND
F
ALL
TIME
ns
(10%
to
90%)
10
9
8
7
6
5
4
3
2
1
0
50
100
150
200
250
FALL TIME
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PDF描述
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參數(shù)描述
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