參數(shù)資料
型號： ADSP-3PARCBF548M01
廠商： Analog Devices Inc
文件頁數(shù)： 41/100頁
文件大?。?/td> 0K
描述： MODULE BOARD BF548
產(chǎn)品培訓模塊： Arcturus uCBF54x-EMM
特色產(chǎn)品： uCBF54x Start Kit and System Module by Arcturus
標準包裝： 5
系列： Blackfin®
模塊/板類型： 處理器模塊
適用于相關(guān)產(chǎn)品： ADSP-BF548
相關(guān)產(chǎn)品： ADSP-BF548MBBCZ-5M-ND - IC DSP 533MHZ W/DDR 400CSPBGA
ADSP-BF548BBCZ-5A-ND - IC DSP 16BIT 533MHZ 400CSBGA
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
Table 29. Asynchronous Memory Read Cycle Timing with Asynchronous ARDY
Parameter
Min
Max
Unit
Timing Requirements
tSDAT
DATA15 – 0 Setup Before CLKOUT
5.0
ns
tHDAT
DATA15 – 0 Hold After CLKOUT
0.8
ns
tDANR
ARDY Negated Delay from AMSx Asserted1
(S + RA – 2)
× t
SCLK
ns
tHAA
ARDY Asserted Hold After ARE Negated
0.0
ns
Switching Characteristics
tDO
Output Delay After CLKOUT2
6.0
ns
tHO
Output Hold After CLKOUT
0.3
ns
1 S = number of programmed setup cycles, RA = number of programmed read access cycles.
2 Output pins include AMS3–0, ABE1–0, ADDR19–1, AOE, and ARE.
Figure 14. Asynchronous Memory Read Cycle Timing with Asynchronous ARDY
SETUP
2 CYCLES
PROGRAMMED READ
ACCESS 4 CYCLES
ACCESS EXTENDED
3 CYCLES
HOLD
1 CYCLE
tDO
tHO
tDO
tDANR
tSDAT
tHDAT
CLKOUT
AMSx
ABE1–0
ADDR19–1
AOE
ARE
ARDY
DATA 15–0
tHO
tHAA
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PDF描述
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