參數(shù)資料
型號： ADSP-21992YBC
廠商： Analog Devices Inc
文件頁數(shù)： 44/60頁
文件大?。?/td> 0K
描述： IC DSP CTLR 16BIT 196CSPBGA
標準包裝： 1
系列： ADSP-21xx
類型： 定點
接口： SPI，SSP
時鐘速率： 150MHz
非易失內(nèi)存： 外部
芯片上RAM： 128kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 196-BGA
供應商設備封裝： 196-MBGA（15x15）
包裝： 托盤
ADSP-21992
Rev. A
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August 2007
JTAG Test and Emulation Port Timing
Table 26 and Figure 18 describe JTAG port operations.
Table 26. JTAG Port Timing
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
4
ns
tHTAP
TDI, TMS Hold After TCK High
4
ns
tSSYS
System Inputs Setup Before TCK Low1
4ns
tHSYS
System Inputs Hold After TCK Lowa
5ns
tTRSTW
TRST Pulse Width2
4tTCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
8
ns
tDSYS
System Outputs Delay After TCK Low3
022
ns
1 System outputs = DATA15–0, ADDR21–0, MS3–0, RD, WR, ACK, CLKOUT, BG, PF15–0, DT, TCLK, RCLK, TFS, RFS, BMS.
2 50 MHz maximum.
3 System inputs = DATA15–0, ADDR21–0, RD, WR, ACK, BR, BG, PF15–0, DR, TCLK, RCLK, TFS, RFS, CLKOUT, RESET.
Figure 18. JTAG Port Timing
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
TCK
tTCK
tHTAP
tSTAP
tDTDO
tSSYS
tHSYS
tDSYS
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