AVDD = DVDD = 5 V, OVDD = 2.7 V to 5.25 V; VREF
參數(shù)資料
型號： AD7655ASTZRL
廠商： Analog Devices Inc
文件頁數(shù)： 24/28頁
文件大小： 0K
描述： IC ADC 16BIT 4CHAN 48LQFP
標(biāo)準(zhǔn)包裝： 2,000
系列： PulSAR®
位數(shù)： 16
采樣率（每秒）： 1M
數(shù)據(jù)接口： 串行，并聯(lián)
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 135mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 2 個差分，單極
配用： EVAL-AD7655CBZ-ND - BOARD EVALUATION FOR AD7655
AD7655
Rev. B | Page 5 of 28
TIMING SPECIFICATIONS
AVDD = DVDD = 5 V, OVDD = 2.7 V to 5.25 V; VREF = 2.5 V; all specifications TMIN to TMAX, unless otherwise noted.
Table 3.
Parameter
Symbol
Min
Typ
Max
Unit
CONVERSION AND RESET (See Figure 21 and Figure 22)
Convert Pulse Width
t1
5
ns
Time Between Conversions
(Normal Mode/Impulse Mode)
t2
2/2.25
μs
CNVST Low to BUSY High Delay
t3
32
ns
BUSY High All Modes Except in Master Serial Read After Convert Mode
(Normal Mode/Impulse Mode)
t4
1.75/2
μs
Aperture Delay
t5
2
ns
End of Conversions to BUSY Low Delay
t6
10
ns
Conversion Time
(Normal Mode/Impulse Mode)
t7
1.75/2
μs
Acquisition Time
t8
250
ns
RESET Pulse Width
t9
10
ns
CNVST Low to EOC High Delay
t10
30
ns
EOC High for Channel A Conversion
(Normal Mode/Impulse Mode)
t11
1/1.25
μs
EOC Low after Channel A Conversion
t12
45
ns
EOC High for Channel B Conversion
t13
0.75
μs
Channel Selection Setup Time
t14
250
ns
Channel Selection Hold Time
t15
30
ns
PARALLEL INTERFACE MODES (See Figure 23 to Figure 27)
CNVST Low to DATA Valid Delay
t16
1.75/2
μs
DATA Valid to BUSY Low Delay
t17
14
ns
Bus Access Request to DATA Valid
t18
40
ns
Bus Relinquish Time
t19
5
15
ns
A/B Low to Data Valid Delay
t20
40
ns
MASTER SERIAL INTERFACE MODES (See Figure 28 and Figure 29)
t21
10
ns
t22
10
ns
CS Low to SDOUT Delay
t23
10
ns
t24
250/500
ns
t25
3
ns
Internal SCK Period2
t26
23
40
ns
Internal SCLK High2
t27
12
ns
Internal SCLK Low2
t28
7
ns
SDOUT Valid Setup Time2
t29
4
ns
SDOUT Valid Hold Time2
t30
2
ns
SCLK Last Edge to SYNC Delay2
t31
1
ns
CS High to SYNC HI-Z
t32
10
ns
CS High to Internal SCLK HI-Z
t33
10
ns
CS High to SDOUT HI-Z
t34
10
ns
t35
(Normal Mode/Impulse Mode)
t36
0.75/1
μs
SYNC Deasserted to BUSY Low Delay
t37
25
ns
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PDF描述
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