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參數(shù)資料
| 型號(hào)： | A14100A-STDCQG256B |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1377 CLBS, 30000 GATES, 85 MHz, CQFP256 |
| 封裝： | CERAMIC, QFP-256 |
| 文件頁數(shù)： | 11/54頁 |
| 文件大小： | 343K |
| 代理商： | A14100A-STDCQG256B |
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RadTolerant FPGAs
v3.1
1-15
Sequential Timing Characteristics
D represents all data functions involving A, B, and S for multiplexed flip-flops.
Figure 1-13 Flip-Flops and Latches (RT1280A, A1280A)
D represents all data functions involving A, B, and S for multiplexed flip-flops.
Figure 1-14 Flip-Flops and Latches (RT1425A, A1425A, RT1460A, A1460A, RT14100A, A14100A)
t RS
(Positive Edge Triggered)
D
CLK
CLR
PRE
Y
D1
G, CLK
Q
PRE, CLR
tWCLKA
tWASYN
t HD
t SUD
t A
t
t HENA
SUENA
tco
E
t CLR
(Positive Edge Triggered)
D
CLK
CLR
PRESET
Y
D1
G, CLK
Q
CLR
tWCLKA
tWASYN
t HD
t SUD
t A
t
t HENA
SUENA
tCO
E
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A14100A-STDCQG256M | FPGA, 1377 CLBS, 30000 GATES, 85 MHz, CQFP256 |
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| A1460A-TQ176M | FPGA, 848 CLBS, 6000 GATES, 100 MHz, PQFP176 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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