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參數(shù)資料
| 型號： | 82801FR |
| 廠商： | Intel Corp. |
| 英文描述： | Intel I/O Controller Hub 6 (ICH6) Family |
| 中文描述： | 英特爾I / O控制器集線器6（ICH6）家庭 |
| 文件頁數(shù)： | 373/462頁 |
| 文件大?。?/td> | 3450K |
| 代理商： | 82801FR |
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Intel
82801BA ICH2 Datasheet
13-3
AC’97 Audio Controller Registers (D31:F5)
13.1.4
PCISTS—PCI Device Status Register (Audio—D31:F5)
Offset:
Default Value
Lockable:
07h–06h
0280h
No
Attribute:
Size:
Power Well:
R/WC
16 bits
Core
PCISTA is a 16-bit status register. Refer to the PCI 2.1 specification for complete details on each
bit.
13.1.5
RID—Revision Identification Register (Audio—D31:F5)
Offset:
Default Value:
Lockable:
08h
See bit description
No
Attribute:
Size:
Power Well:
RO
8 Bits
Core
13.1.6
PI—Programming Interface Register (Audio—D31:F5)
Offset:
Default Value:
Lockable:
09h
00h
No
Attribute:
Size:
Power Well:
RO
8 bits
Core
Bit
Description
15
Detected Parity Error (DPE). Not implemented. Hardwired to 0.
14
SERR# Status (SERRS). Not implemented. Hardwired to 0.
13
Master-Abort Status (MAS)
—R/WC.
1 = Bus Master AC '97 2.1 interface function, as a master, generates a master abort.
0 = Software clears this bit by writing a 1 to the bit position.
12
Reserved. Will always read as 0.
11
Signaled Target-Abort Status (STA). Not implemented. Hardwired to 0.
10:9
DEVSEL# Timing Status (DEVT)—
RO.
This 2-bit field reflects the ICH2's DEVSEL# timing when
performing a positive decode.
01b = Medium timing.
8
Data Parity Detected (DPD). Not implemented. Hardwired to 0.
7
Fast Back to back Capable (FBC).
Hardwired to 1. This bit indicates that the ICH2 as a target is
capable of fast back-to-back transactions.
6
UDF Supported. Not implemented. Hardwired to 0.
5
66 MHz Capable. Hardwired to 0.
4:0
Reserved. Read as 0's.
Bit
Description
7:0
Revision ID Value—
RO. Refer to the ICH2 / ICH2-m Specification Update for the value of the
Revision ID Register
Bit
Description
7:0
Programming Interface—
RO.
ICminer.com Electronic-Library Service CopyRight 2003
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82801DB | Intel 82801DB I/O Controller Hub 4 (ICH4) |
| 82801AA | 82801AB (ICH0) I/O Controller Hub |
| 82801AB | 82801AB (ICH0) I/O Controller Hub |
| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
| 82804AA | Interface IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| 82801GDHICH7DH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GHMICH7-MDH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GRICH7R | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
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