參數(shù)資料
型號： UPD78F1146AGK-GAJ-AX
廠商： Renesas Electronics America
文件頁數(shù)： 835/880頁
文件大小： 0K
描述： MCU 16BIT 78K0R/KX3 64-LQFP
標準包裝： 300
系列： 78K0R/Kx3
核心處理器： 78K/0R
芯體尺寸： 16-位
速度： 20MHz
連通性： 3 線 SIO，I²C，LIN，UART/USART
外圍設備： DMA，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 50
程序存儲器容量： 256KB（256K x 8）
程序存儲器類型： 閃存
RAM 容量： 12K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 托盤
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APPENDIX B LIST OF CAUTIONS
User’s Manual U17854EJ9V0UD
848
(24/33)
Chapter
Cl
assi
fi
cati
on
Function
Details of
Function
Cautions
Page
LVIM:Low-
Voltage
detection
register
When LVI is used in interrupt mode (LVIMD = 0) and LVISEL is set to 0, an interrupt
request signal (INTLVI) that disables LVI operation (clears LVION) when the supply
voltage (VDD) is less than or equal to the detection voltage (VLVI) (if LVISEL = 1, input
voltage of external input pin (EXLVI) is less than or equal to the detection voltage
(VEXLVI)) is generated and LVIIF may be set to 1.
p.633
Be sure to clear bits 4 to 7 to “0”.
p.634
Change the LVIS value with either of the following methods.
When changing the value after stopping LVI
<1> Stop LVI (LVION = 0).
<2> Change the LVIS register.
<3> Set to the mode used as an interrupt (LVIMD = 0).
<4> Mask LVI interrupts (LVIMK = 1).
<5> Enable LVI operation (LVION = 1).
<6> Before cancelling the LVI interrupt mask (LVIMK = 0), clear it with software
because an LVIIF flag may be set when LVI operation is enabled.
When changing the value after setting to the mode used as an interrupt (LVIMD =
0)
<1> Mask LVI interrupts (LVIMK = 1).
<2> Set to the mode used as an interrupt (LVIMD = 0).
<3> Change the LVIS register.
<4> Before cancelling the LVI interrupt mask (LVIMK = 0), clear it with software
because an LVIIF flag may be set when the LVIS register is changed.
p.635
LVIS: Low-
voltage detection
level select
register
When an input voltage from the external input pin (EXLVI) is detected, the detection
voltage (VEXLVI) is fixed. Therefore, setting of LVIS is not necessary.
p.635
<1> must always be executed.
When LVIMK = 0, an interrupt may occur
immediately after the processing in <4>.
p.637
Used as reset
(when detecting
level of supply
voltage (VDD))
(LVIOFF = 1)
If supply voltage (VDD)
≥ detection voltage (VLVI) when LVIMD is set to 1, an internal
reset signal is not generated.
p.637
Used as reset
(when detecting
level of supply
voltage (VDD))
(LVIOFF = 0)
Even when the LVI default start function is used, if it is set to LVI operation
prohibition by the software, it operates as follows:
Does not perform low-voltage detection during LVION = 0.
If a reset is generated while LVION = 0, LVION will be re-set to 1 when the CPU
starts after reset release. There is a period when low-voltage detection cannot be
performed normally, however, when a reset occurs due to WDT and illegal
instruction execution.
This is due to the fact that while the pulse width detected by LVI must be 200
μs
max., LVION = 1 is set upon reset occurrence, and the CPU starts operating
without waiting for the LVI stabilization time.
p.639
<1> must always be executed.
When LVIMK = 0, an interrupt may occur
immediately after the processing in <3>.
p.641
Soft
If input voltage from external input pin (EXLVI)
≥ detection voltage (VEXLVI = 1.21 V
(TYP.)) when LVIMD is set to 1, an internal reset signal is not generated.
p.641
Chapter
2
0
Hard
Low-
voltage
detector
Used as reset
(when detecting
level of input
voltage from
external input pin
(EXLVI))
Input voltage from external input pin (EXLVI) must be EXLVI < VDD.
p.641
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