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參數(shù)資料
| 型號： | UPD70F3271YGF-JBT-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 101/129頁 |
| 文件大小： | 8549K |
| 代理商： | UPD70F3271YGF-JBT-A |
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CHAPTER 3 CPU FUNCTION
User’s Manual U16541EJ5V1UD
73
(3) On-chip peripheral I/O area
4 KB of addresses 03FFF000H to 03FFFFFFH are reserved as the on-chip peripheral I/O area.
Figure 3-12. On-Chip Peripheral I/O Area
On-chip peripheral I/O area
(4 KB)
03FFFFFFH
03FFF000H
FFFFFFFFH
FFFFF000H
Physical address space
Logical address space
Peripheral I/O registers that have functions to specify the operation mode for and monitor the status of the on-
chip peripheral I/O are mapped to the on-chip peripheral I/O area. Program cannot be fetched from this area.
Cautions 1. When a register is accessed in word units, a word area is accessed twice in halfword
units in the order of lower area and higher area, with the lower 2 bits of the address
ignored.
2. If a register that can be accessed in byte units is accessed in halfword units, the higher 8
bits are undefined when the register is read, and data is written to the lower 8 bits.
3. Addresses not defined as registers are reserved for future expansion. The operation is
undefined and not guaranteed when these addresses are accessed.
4. The internal ROM/RAM area and on-chip peripheral I/O area are assigned to successive
addresses. When accessing the internal ROM/RAM area by incrementing or decrementing
addresses using pointer operations and such, therefore, be careful not to access the on-
chip peripheral I/O area by mistakenly extending over the internal ROM/RAM area
boundary.
<R>
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD70F3261YGF-JBT-A | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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